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  • 发布了文章 2024-11-14 11:12
    在系统级仿真中,与DDR4-3200 相比,更高数据速率下的 DDR5 的有效带宽几乎是其两倍。这种改进是通过提高数据速率和增强架构来实现的。DDR5 包含从 3200 MT/s 到 8800 MT/s 的数据速率。一个值得注意的特性是在D...
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  • 发布了文章 2024-7-16 17:47
    DDR5标准JESD79-5文件中没有明确的控制阻抗建议,DDR4时代基本内存条上时钟阻抗还是跟着芯片、主板走的70-80欧姆。线宽相对而言比较细。不知道你开始使用DDR5没有,你有关注过DDR5内存条上的时钟走线吗?...
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  • 发布了文章 2023-2-24 13:53
    阻抗一致性优越,单端阻抗50±5%(差分阻抗100±5%)极低插入损耗...
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  • 发布了文章 2023-2-23 12:40
    MICRO_HDMI单板全部走微带线,不打孔,阻抗设计控制单端50(差分100欧姆),采用线缆直出配高速SMA接头与仪器连接(最大带宽支持40Ghz)。...
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  • 发布了文章 2023-2-17 10:21
    适用于阻抗条测试,信号完整性验证、共面波导、电路调试及测试装置用途,基本可以做到高速信号测试无死角。适用于微波集成电路在片测试、MEMS产品测试及片上天线测试等领域。...
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  • 发布了文章 2023-2-2 15:47
    迪赛康科技一直专注于高速相关的产品研发,已经陆续推出全系列接口高速测试夹具,多款同轴连接器和测试探针等高速相关产品。...
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  • 发布了文章 2023-2-1 10:00
    适用于阻抗条测试,信号完整性验证、共面波导、电路调试及测试装置用途,基本可以做到高速信号测试无死角。...
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  • 发布了文章 2022-12-8 15:55
    测试一:先将网分与线缆校准后,然后连接两个探针测试DUT,将两个探针的S参数、两个探针+DUT的整体S参数分别导出,然后使用PLTS校准软件将探针本身S参数去嵌,得到单独DUT的S参数。...
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  • 发布了文章 2022-10-28 16:10
    时域夹具移除法的第一步是测量直通夹具的时域响应,如图1所示。尽管夹具可能只在窄频带内使用,为了得到最佳时域分辨率,仍应在尽可能宽的频率范围进行测 量。响应的峰值显示了夹具的总时延,或者可以用群时延响应的平均值。很多情况下,输入和输出夹具都被...
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  • 发布了文章 2022-10-10 09:33
    迪赛康DDR4/DDR5 Interposr测试板专门为内存颗粒测试设计,阻抗一致性优异,极低延迟,最高速率支持6.4Gbps,可以用于78pin和96pin/102pin封装的DDR4和DDR5颗粒测试。...
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  • 发布了文章 2022-9-6 15:05
    2.92mm同轴转接头:适用于带宽40GHz,用于连接矢网线缆和测试板,转接头和测试板配合的位置需要进行仿真匹配阻抗。...
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  • 发布了文章 2022-4-15 17:55
      迪赛康科技(深圳)有限公司一直专注于高频、高速相关的产品研发,已经陆续推出全系列接口高速测试夹具,多款同轴连接器,高频高速线缆和测试探针等高速相关产品,并申请专利。...
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  • 发布了文章 2021-11-19 10:26
    1.应用场景 支持8Gbps(4Ghz),12.5Gbps(6.25Ghz)和16Gbps(8Ghz)多种速率损耗应用 2.主要特点 ·  阻抗一致性优越,差分阻抗100Ω±%5。 ·  极低的插入损耗。 ·  SI性能优化至16Gbps ...
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  • 发布了文章 2021-11-19 10:23
    1.应用场景 支持M.2接口基板测试(M.2-Based Board Test)。 2.主要特点 · 阻抗一致性优越,差分阻抗85Ω±%5。 · 极低的插入损耗。 · 各通道skew差异小于±2ps。 · SI性能优化至16Gbps,符合P...
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  • 发布了文章 2021-3-31 17:09
    先说接触最广的PCIE,这个不难理解,这个是总线标准,X1,X4,X8,X16,外形啥样,当然是金手指,但是左边那个金手指好像不是PCIE的接口,这个时候就要来说SFF8639,其实这个SFF8639就是我们经常说的U.2接口,不用解释,看...
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