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工程师 中科驭数
北京 海淀 设计开发工程师
  • 回答了问题 2023-6-6 18:37

    xilinx vivado调用cordic IP核进行实现时报错多重驱动?

    ?
    大概率是语法问题,以下仅供参考:
  • 回答了问题 2023-6-6 17:29

    如何自学并精进FPGA

    学生
    写的有点乱,仅供参考
  • 回答了问题 2023-6-5 13:51

    fpga v6板 上电后指示灯红色常亮 找不到驱动

    //------v6板 “v6板”的具体型号是哪个?不同开发板的Led有不同的意义。 //------红色的灯 根据你的描述,红色的LED灯在正常情况下闪烁,应该是FPGA普通的IO连接的LED。FPGA的程序控制LED闪烁。 当FPGA的程序被擦除 ...
  • 回答了问题 2023-6-5 09:40

    使用ISE子模块之间没有连接

    学生
    检查一下代码中的模块例化的正确性,包括端口信号是否正确。
  • 回答了问题 2023-5-31 14:17

    ISE进行工程综合时出现资源使用过多的问题

    学生
    //------为什么有些乘法运算没有使用MULT16X16,而是使用slice,lut资源来实现 FPGA的Synthesis和Impl对于资源的占用需要在代码或者约束文件中指定使用MULT16X16才行,否则它会依据你选择的策略(包括默认策略)自动 ...
  • 回答了问题 2023-5-24 14:04

    变模计数器

    通过定时切换或者计数器切换。
  • 回答了问题 2023-5-24 11:18

    基于FPGA的BISS-C协议编码器的解码实现

    你先参考一下这个:
  • 回答了问题 2023-5-23 18:49

    Occamy RISC-V 前景如何

    教职工
    建议从通用的RSIC-V着手,小众的局限性比较多。
  • 回答了问题 2023-5-23 18:48

    哪款RISC-V芯片最便宜

    副研究员
    沁恒微和兆易创新
  • 回答了问题 2023-5-16 18:19

    Zynq PCIe电路设计

    //------说明 这个问题属于硬件问题,不算FPGA的问题。 //------思路 1.“连接器+金手指”工作正常,说明阻抗匹配无问题; 2.“连接器”工作异常,说明阻抗匹配存在问题; 3.建议尝试PCIE-1.0(Gen1.0),且1X的模式 ...
  • 回答了问题 2023-5-16 18:09

    为什么我fpga的io口输出速率只能做到8mhz呢?

    从硬件角度分析,你的IO管脚需要添加RC器件来提高输出速率。 如果只有8MHz的工作频率,检查输入时钟或者时钟分配参数是否正确。
  • 回答了问题 2023-5-4 17:41

    CPLD驱动PCF8591ADC采样老是零

    工程师 人先医疗科技有限公司
    假如读取的数据全为零,需要检查I2C链路是否缺少上拉电阻; 加入读取的数据全为0xff,需要检查访问地址和寄存器是否正确。 依据你的现象描述,需要检查硬件电路。注意此时的管脚内部上拉是无效的,必须外部电路有上 ...
  • 回答了问题 2023-5-4 17:06

    FPGA烧写文件的问题

    工程师 人先医疗科技有限公司
    //------JTAG JTAG支持在线调试模式的sof文件,以及烧录jic文件。(sof转成jic文件) //------固化 通常固化使用pof文件;也有通过JTAG烧录jic文件的方式。 //------调试DEBUG 对于你用的FPGA来讲,需要结合Signal-T ...
  • 回答了问题 2023-4-26 20:17

    Vivado生成IP核

    工程师
    //------ 不管哪种情况(modelsim、打开ise工程),理论上讲对vivado工具和工程无影响。 //------可能原因: 截图现象是IP的文件缺失,通常有三种相对常见的情况可能会导致该种情况(不止这三种): 1.IP刚刚创建, ...
  • 回答了问题 2023-4-19 12:48

    黑金Xilinx7020扩展板PCB出板文件

    学生
    直接挂在“闲鱼”上静待有缘人……
ta 的专栏

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