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卿小小_9e6
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工程师 中科驭数
北京 海淀 丨 设计开发工程师
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他的提问 2 他的回答 437 去回答
  • 回答了问题 2019-11-15 11:23

    FPGA的移位寄存器

    wenxuanshao16
    学生
    流程图和功能要求发出来，是否需要仿真，会的话免费写。
  • 回答了问题 2019-11-7 16:02

    器件讨论

    zcy55303370
    工人 成都工业学院
    这个是全部零配件吗？ 感觉有点像BNC公头终端负载，做阻抗匹配用。 静待大神解答……
  • 回答了问题 2019-11-6 20:57

    IMPACT在烧录的时候提示检查电源连接

    Aye7
    学生
    IMPACT的警告影响程序正常烧录吗？不影响烧录程序的话可以忽略警告。 01.大多数情况是下载器/仿真器接触问题，常用的处理方式是在FPGA断电情况下重新插拔（USB线和电脑，USB线和仿真器，仿真器和杜邦线，杜邦线和JT ...
  • 回答了问题 2019-10-29 16:57

    为什么我的计数器不计数呢modelsim仿真

    fpgalover1
    学生
    你的代码没有问题，我复制后直接仿真可以正常运行。 问题出在你的观察窗口，你观察的是激励文件led1_vlg_tst.v的计数器cnt，它没有逻辑操作，也没有initial初始化，所以一直是x。你把逻辑代码led1.v里的端口添加到仿 ...
  • 回答了问题 2019-10-28 14:35

    新手求教，怎么用vio控制输入

    神奇艾尔斯
    学生
    01.首先解决语法问题。(*keep=“true”*)。 代码里true写成了ture;always块的代码里，IF大写是错误的； count的赋值使用了阻塞赋值“=”，应该改为非阻塞赋值“ ...
  • 回答了问题 2019-10-28 14:04

    rdsig<=1'd0;什么意思

    我爱妖妖
    无
    rdsig看起来像是“读信号”的意思（read_signal），名字有FPGA开发者自己定义。具体它在代码里什么功能，需要结合代码分析。
  • 回答了问题 2019-10-28 13:56

    新手求教，怎么用vio控制输入

    神奇艾尔斯
    学生
    01.首先解决语法问题。(*keep=“true”*)。 代码里true写成了ture;always块的代码里，IF大写是错误的； count的赋值使用了阻塞赋值“=”，应该改为非阻塞赋值“ true (*keep="true"*) reg [9:0] data_vio ;//set fr ...
  • 回答了问题 2019-10-28 09:57

    新手求教，怎么用vio控制输入

    神奇艾尔斯
    学生
    不知什么原因，工程压缩包36.5MB无法上传。我这边可以正常上板调试的代码做成压缩包counter.rar，截图版本是Vivado2019.1。 板卡晶振40MHz，约束XDC文件没有做特别设置（Vivado综合的时候会报warning，可以忽略）。 ...
  • 回答了问题 2019-10-25 10:07

    FPGA 高速信号

    叫我阿gu就好
    数字IC工程师 无
    0.5ns的相位差，目前FPGA不行，只能仿真。你这是国家重点项目吗？如果不是，那么想一下这种信号测量的意义在哪里？——基本没意义才对，在误差接受范围内即可。 国外仪器有ps脉冲发生器（ps时钟源），同时国内外均有 ...
  • 回答了问题 2019-10-25 09:34

    FPGA 高速信号

    叫我阿gu就好
    数字IC工程师 无
    0.5ns的相位差，目前FPGA不行，只能仿真。你这是国家重点项目吗？如果不是，那么想一下这种信号测量的意义在哪里？——基本没意义才对，在误差接受范围内即可。国外仪器有ps脉冲发生器（ps时钟源）。 ...
  • 回答了问题 2019-10-24 18:31

    请问如何用Verilog设计密勒码编码器？

    似若有无布
    学生
    参考这个：密勒码编码器和解码器的设计 http://ishare.iask.sina.com.cn/f/303nhZ9VDC9.html
  • 回答了问题 2019-10-24 18:22

    FPGA下载问题

    为你神
    嵌入式工程师 北京英迪普蒂科技有限公司
    01.首先回答问题，两个FPGA都是片外FLASH存储程序。 02.其中XC5VLX110是Virtex5系列FPGA，常用ISE14.6/ISE14.7开发程序；XC2C256是Virtex2系列FPGA，常用ISE10.1（8.x~11.x都可以）开发程序。 03.片外FLASH可能是U1 ...
  • 回答了问题 2019-10-24 18:20

    FPGA下载问题

    为你神
    嵌入式工程师 北京英迪普蒂科技有限公司
    01.首先回答问题，两个FPGA都是片外FLASH存储程序。 02.其中XC5VLX110是Virtex5系列FPGA，常用ISE14.6/ISE14.7开发程序；XC2C256是Virtex2系列FPGA，常用ISE10.1（8.x~11.x都可以）开发程序。 03.片外FLASH可能是U1 ...
  • 回答了问题 2019-10-24 17:44

    FPGA下载问题

    为你神
    嵌入式工程师 北京英迪普蒂科技有限公司
    个人猜测： 01.首先回答你的问题，两片FPGA的程序都在外部FLASH中存储，FPGA内无程序； 02.两片FPGA都是Xilinx。XC5VLX110是Virtex5系列，开发环境常用ISE14.6/ISE14.7；XC2C256是Virtex2系列，开发环境常用ISE10.1 ...
  • 回答了问题 2019-10-24 17:12

    如何产生带有死区时间控制的互补pwm？

    菜鸟求罩
    研究生
    补充一下代码和仿真代码：
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