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  • 回答了问题 2019-7-25 09:23

    为什么Spartan 6 block ram有2个时钟延迟?

    嗨Gabor, 感谢您的回复。 是的你是对的我正在进行路线后模拟。 我对行为模拟也没有问题。 我认为后期模拟比关于时间的行为模拟更准确。 我的应用是100Mhz时钟,当地址在周期n上计时时数据在周期n + 1输出。 在spart ...
  • 回答了问题 2019-7-25 09:03

    为什么Spartan 6 block ram有2个时钟延迟?

    嗨Vanitha, 感谢您的快速回复。 我读了延迟部分。 它表示如果有输出重定时器,它将增加一个额外的时钟周期延迟。 但在我的配置中,我没有选择输出寄存器。 我使用的是ISE 13.4,内存核心版本是V6.3。 请您打开我的 ...
  • 回答了问题 2019-7-24 09:51

    如何在SPARTAN 6 phy的GEN1和GEN2时钟生成之间切换

    您需要通过DRP控制PLL_TXDIVSEL_OUT和PLL_RXDIVSEL_OUT属性。请在通过DRP更新这些参数后应用GTPRESET。 -------------------------------------------------- ----------------------------别忘了回复,给予kudo并 ...
  • 回答了问题 2019-7-23 14:48

    无法在极光的接收器上得到软信号该怎么办?

    确认您遵循协议要求以在模拟中传输帧。 -------------------------------------------------- ----------------------------别忘了回复,给予kudo并接受为解决方案--------- ------------------------------------ ...
  • 回答了问题 2019-7-23 14:36

    无法在极光的接收器上得到软信号该怎么办?

    你发送了多少帧? 如果您发送多个帧并且没有为它们显示SOF,我希望得到frame_err断言。 是这样的吗? -------------------------------------------------- ----------------------------别忘了回复,给予kudo并接 ...
  • 回答了问题 2019-7-23 11:37

    请问有几个GTP可以与usrclk2共享DCM

    上述第二种方法不需要额外的MMCM来生成RXUSRCLK,并且从TXOUTCLK生成的USRCLK可以用于结构FIFO的读时钟。 -------------------------------------------------- ----------------------------别忘了回复,给予kudo ...
  • 回答了问题 2019-7-23 11:27

    请问有几个GTP可以与usrclk2共享DCM

    两个GTP的RXRECCLK可能不具有相同的准确度。 由于其中一个用作写时钟而另一个用作读时钟,因此可以观察到溢出/下溢。 您是否可以检查是否可以使用从TXOUTCLK生成的USRCLK用于RXUSRCLK?(或)您可以使GT Rx接口宽度 ...
  • 回答了问题 2019-7-23 10:56

    请问有几个GTP可以与usrclk2共享DCM

    如果您正在共享使用其他通道的RXRECCLK生成的RXUSRCLK,请查看RXBUFSTATUS。 它可能会报告上溢或下溢。如果禁用RX缓冲区,则无法使用时钟校正。 -------------------------------------------------- ------------- ...
  • 回答了问题 2019-7-23 10:38

    请问有几个GTP可以与usrclk2共享DCM

    我应该说得更清楚。 gtpclkout0(0)用于TXOUTCLK,gtpclkout0(1)用于RXRECCLK。 您可以在共享的相同图片中找到它。 GTPCLKOUT(1)有路径。如果您正在共享GTPCLOUT(1),我也无法正确理解。 如果是,则应启用R ...
  • 回答了问题 2019-7-23 10:06

    请问有几个GTP可以与usrclk2共享DCM

    gtpclkout0(0)用于Tx,gtpclkout0(1)用于Rx。 你发现设计在模拟中工作吗? 如果您使用逗号对齐,请检查此模块的状态信号以开始。 -------------------------------------------------- ----------------------- ...
  • 回答了问题 2019-7-23 09:28

    用于音频应用的异步采样率转换器无法输出

    这是波形 以上来自于谷歌翻译 以下为原文   This is the waveform
  • 回答了问题 2019-7-23 09:19

    用于音频应用的异步采样率转换器无法输出

    嗨ayusman, 我和你一样有同样的问题。 我使用一个简单的测试平台来模拟ASRC核心: mclk:200 MHz clkin:96KHz clkout:48KHz manual_ratio_en ='0' manual_ratio =全0 imput_sample_a和imput_sample_b是随机值,随 ...
  • 回答了问题 2019-7-22 12:51

    如何在S6SLX9 FPGA上从4MHz输入时钟获得80MHz时钟

    您是否模拟了DCM实例化? 是否工作正常?我建议使用时钟向导生成实例化,并比较是否需要更新参数。 -------------------------------------------------- ----------------------------别忘了回复,给予kudo并接受 ...
  • 回答了问题 2019-7-17 08:10

    请问selectIO向导假设输入时钟是280MHz吗?

    你能展示精灵快照吗? -------------------------------------------------- ----------------------------别忘了回复,给予kudo并接受为解决方案--------- -------------------------------------------------- ...
  • 回答了问题 2019-7-16 09:03

    我可以使用XC17v16来配置我的spartan-6 LX100T吗?

    spartan-6 LX100T需要26,691,232bits的容量。 XC17v16没有这么大的容量。 最好选择Platform Flash XCFS和XCFP PROM之一 -------------------------------------------------- ----------------------------别忘了 ...
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