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  • 回答了问题 2019-11-11 16:08

    请问GLCM verilog代码不能正常工作该怎么办?

    有没有其他方法来表示256位8位值形成阵列结构来比较对角线值???
  • 回答了问题 2019-11-11 14:54

    为什么文本文件形成之后是空的?

    $ fopen,$ display和$ fclose仅模拟Verilog函数。 你期望在综合系统中发生什么? ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com ...
  • 回答了问题 2019-11-11 13:47

    如何接口矩阵4x4键盘接口与spartan 3e fpga?

    有一个Spartan-3E板,因此您需要检查您需要确定引脚位置的电路​​板的原理图或用户指南。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com ...
  • 回答了问题 2019-11-11 10:45

    如何率板zc702?

    你提出的问题没有答案。 我建议您在产品页面http://www.xilinx.com/products/boards-and-kits/EK-Z7-ZC702-G.htm上查看ZC702的功能集,或者了解硬件用户的详细信息 指导UG850。 ------您是否尝试在Google中输入问题 ...
  • 回答了问题 2019-11-11 07:56

    哪里可以找到Xilinx芯片晶体管通道长度的规格?

    您的项目非常不寻常,并且通过这种比较不清楚您希望实现的目标。 如果要查明FPGA是否较慢,那么肯定是。 350nm = 0.35um,Xilinx在此过程节点中具有以下系列。 XC9500XL XC4000XL XC4000XLA XCR3000XL(CoolRunner X ...
  • 回答了问题 2019-11-11 07:21

    哪里可以找到Xilinx芯片晶体管通道长度的规格?

    您的项目非常不寻常,并且通过这种比较不清楚您希望实现的目标。 如果要查明FPGA是否较慢,那么肯定是。 350nm = 0.35um,Xilinx在此过程节点中具有以下系列。 XC9500XL XC4000XL XC4000XLA XCR3000XL(CoolRunner X ...
  • 回答了问题 2019-11-8 16:25

    如何清除输出声明的错误?

    谢谢,但它再次显示错误: 错误:HDLC编译器:246 - “txete.v”第7行向量reg'douta'的引用不是合法的网络lvalueERROR:HDLCompilers:102 - “txete.v”第7行连接到输出端口'douta'必须是净lvalueERROR :HDLCompi ...
  • 回答了问题 2019-11-8 12:32

    MAP合成过程中显示过多错误该怎么办?

    嗨Sunil, 我在询问设计中的Block RAM(BRAM)利用率(检查综合报告)。 请分享.syr报告文件。 问候, Achutha -------------------------------------------------- ------------------------------------------- ...
  • 回答了问题 2019-11-7 08:58

    如何在vhdl中写文本长凳?

    编写测试平台是通过应用激励并检查输出是否满足预期结果来持续验证设计的最佳和最可靠的方法。 测试台通常具有大量的刺激和输出矢量,这对于手动输入模拟器是不切实际的。 ------您是否尝试在Google中输入问题? 如 ...
  • 回答了问题 2019-11-5 09:04

    如何更改Spartan 6 GTP收发器时钟引脚?

    >根据我的理解,ISERDES / OSERDES可以通过GTP收发器向导进行编程 你的理解是不正确的。 ISERDES / OSERDES块不是GTP的一部分。 这些模块是非常简单的同步串行到并行和并行到串行模块,是SelectIO功能的一部分,在U ...
  • 回答了问题 2019-11-5 08:28

    如何更改Spartan 6 GTP收发器时钟引脚?

    >我也可以使用CLK_OUT SMA端口进行数据传输。 不,您不能将GTP发送器引脚分配给这些SMA,因为所有GTP引脚都是专用的。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站 ...
  • 回答了问题 2019-11-4 10:21

    如何对xilinx .jed文件进行反汇编?

    我无法获取JED文件并转换回设计源。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com
  • 回答了问题 2019-11-4 10:10

    如何将ML 605板与面包板上的组件连接?

    获取FMC-XM105卡,然后您就可以将低速信号连接到面包板电路。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com ...
  • 回答了问题 2019-11-4 10:01

    如何将ML 605板与面包板上的组件连接?

    获取FMC-XM105卡,然后您就可以将低速信号连接到面包板电路。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com 在原帖中查看解决方案 ...
  • 回答了问题 2019-10-31 07:50

    如何进行FSM任意状态建模 ?

    >只需通过测试平台运行它,看看该模块是否表现得如此, 如果它是随机的那么你怎么知道? 你能解释为什么所有的状态转换都不知道吗? ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? ...
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