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李森

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他的提问 41 他的回答 999 去回答

回答了问题 2020-3-13 08:35

为什么timitng模拟没有给出与功能模拟相同的结果

hiker0088

你还没有说出问题所在。说明你有“错误的结果”而没有提供任何信息和你所期待的，你收到的信息，被测电路和测试条件不允许论坛上的任何人提供有意义的答案。您的上一篇文章表明您的设计不符合时间要求。这是你需 ...
回答了问题 2020-3-13 07:49

为什么timitng模拟没有给出与功能模拟相同的结果

hiker0088

您需要提供有关问题的更多详细信息。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com
回答了问题 2020-3-11 09:53

Xilinx是Xilinx编程的＃XLX XC2C256-7VQG100C吗？

cmh19

没有编程的部件，编程信息（位文件）必须来自客户。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com ...
回答了问题 2020-3-11 08:08

采用zynq-7020（400针）的HiSpi接口

ChristineGu

Aptina HiSPi接口采用Sub-LVDS电气I / O标准。由于7Z020器件的输入仅为输入且7Z020仅具有HR I / O bank，因此您应选择LVDS_25标准并使用外部100欧姆差分电阻进行端接，因为无法在较低的共模下使用内部DIFF_TERM Su ...
回答了问题 2020-3-10 10:22

MGT，GTP，GTX之间的区别是什么？

qwer36

>在virtex pro -II rocketio可以作为MGT，我是否正确？ RocketIO是MGT，Multi-Gigabit Transceiver的营销术语，GTP，GTX，GTH等是针对个别家庭的特定实现。 RocketIO和MGT的术语已被逐步淘汰，但我个人仍继续在非特 ...
回答了问题 2020-3-9 10:15

交换差分对“P”和“N”引脚

vwterwer

反转来自或来自差分I / O的信号将始终适用于每个技术。如果您这样做，您应该在原理图和设计文档中做出明确的说明，以避免与其他工程师混淆，这些工程师会在未来几个月或几年内获得您的设计支持。 ------您是否尝试 ...
回答了问题 2020-3-9 09:35

交换差分对“P”和“N”引脚

vwterwer

这非常简单，只是反转进入OBUFDS的信号或来自HDL代码中的IBUFDS。如果在OBUFDS之前在IOB中有一个寄存器，则需要在寄存器之前反转信号，如果在IBUFDS之后在IOB中有一个寄存器，则需要在寄存器之后反转信号。 ------ ...
回答了问题 2020-3-9 09:30

交换差分对“P”和“N”引脚

vwterwer

这非常简单，只是反转进入OBUFDS的信号或来自HDL代码中的IBUFDS。如果在OBUFDS之前在IOB中有一个寄存器，则需要在寄存器之前反转信号，如果在IBUFDS之后在IOB中有一个寄存器，则需要在寄存器之后反转信号。 ------ ...
回答了问题 2020-3-6 09:44

请问如何在XST中有选择地禁用IBUF/OBUF插入？

ianwhoani

XST绝不会在未连接到顶级端口的网络上插入IBUF或OBUF。任何未连接到顶级端口的东西都不应该附加IBUF或OBUF。合成将在更大的设计中使用的模块，并且应该在没有插入I / O缓冲区的情况下完成。默认情况下，XST会将任 ...
回答了问题 2020-3-6 09:32

请问如何在XST中有选择地禁用IBUF/OBUF插入？

ianwhoani

XST绝不会在未连接到顶级端口的网络上插入IBUF或OBUF。任何未连接到顶级端口的东西都不应该附加IBUF或OBUF。合成将在更大的设计中使用的模块，并且应该在没有插入I / O缓冲区的情况下完成。默认情况下，XST会将任 ...
回答了问题 2020-3-6 08:03

使用Vivado和VREF进行项目编译后，VCCO=2.5V

wyg2829

是的，你是对的。我一直忘记DIFF_TERM和VCCO。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com ...
回答了问题 2020-3-6 07:39

使用Vivado和VREF进行项目编译后，VCCO=2.5V

wyg2829

如果这些银行中唯一的东西是LVDS输入，答案是肯定的。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com ...
回答了问题 2020-3-6 07:08

使用Vivado和VREF进行项目编译后，VCCO=2.5V

wyg2829

分配给Bank 12的每个IO都是LVDS_25输入，这些输入可以使用1.5到3.3V的VCCO。 > Bank15配置与Bank12非常相似，但在这种情况下我发现VCCO = 2.5V a VCCO_15也在您发布的报告文件中列为任何一个。 ------您是否尝试在Go ...
回答了问题 2020-3-6 06:21

使用Vivado和VREF进行项目编译后，VCCO=2.5V

wyg2829

如果这些银行中唯一的东西是LVDS输入，答案是肯定的。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com 在原帖中查看解决方案 ...
回答了问题 2019-11-11 16:39

请问GLCM verilog代码不能正常工作该怎么办？

60user73

谢谢你先生，我得到了答案，但这[7：0]数据[0：2] [0：2]不会合成，在这种情况下我能做什么先生，因为我在系统verilog中做了这个程序，这是没有合成??? ...

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