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李森

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他的提问 41 他的回答 999 去回答

回答了问题 2020-6-8 11:25

用于Virtex-6的PCB去耦电容是什么

Sandyjia

UG373的最新信息是正确的信息。解耦信息在V1.2中更新。 ML605是使用原来的建议创建的，这些建议后来变得更好。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.x ...
回答了问题 2020-6-8 11:16

用于Virtex-6的PCB去耦电容是什么

Sandyjia

UG373的最新信息是正确的信息。解耦信息在V1.2中更新。 ML605是使用原来的建议创建的，这些建议后来变得更好。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.x ...
回答了问题 2020-6-8 10:21

如何在UCF文件中使用BANK0 Signal？

60user91

设置此环境变量只会允许软件忽略无效约束并继续布局和布线，但不会导致工作设计。您对AF15的位置限制不正确。您需要为正在使用的电路板找到正确的引脚。 ------您是否尝试在Google中输入问题？如果没有，你应该在 ...
回答了问题 2020-6-8 09:41

如何将FPGA编程为加法器并使其运行

yangwenzhen

首先，您必须使用Verilog代码并将其合成到门以获取NGC网表文件。然后，您必须使用适当的IO放置和时序约束来获取NGC网表并映射，放置和布线，以将实际设计实现创建为NCD文件。然后，您可以以BIT文件的形式从NCD文件 ...
回答了问题 2020-6-5 17:11

请问GCLK引脚可以用作时钟输出吗？

handsomelchcpp

>就我而言，GCLK用于clk输入。我可以将它用于clk输出吗？每个FPGA系列都有一个引脚分布用户指南，描述每个引脚的功能。引脚名称描述以“IO”标识开头，用作输入或输出。如果引脚名称包含“GC”设计，则意味着它 ...
回答了问题 2020-6-5 11:40

使用两个级联MMCM第二个是否会影响第一个MMCM的抖动？

handsomelchcpp

第二个MMCM不会对第一个MMCM产生影响。但第一个MMCM将对第二个MMCM输出的抖动产生影响。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com ...
回答了问题 2020-6-4 12:35

蓝牙如何发大量数据？

harrysummer

蓝牙手环，属于智能穿戴应用领域，目前喆华在此领域拥有比较成熟的案例和市场，同时配备相应客户端。其主控芯片为A81X07。
回答了问题 2020-6-4 11:20

信号通过V5芯片上的铜线的传输速度是多少？

sulidudu

这是OP在十月开始的另一个线程的重生 http://forums.xilinx.com/t5/Virtex-Family-FPGAs/hello-A-question-about-v5-s-routing-resources/m-p/99156 OP需要一定程度的精度，这在FPGA或任何ASIC中都是不可能的。 ---- ...
回答了问题 2020-6-3 16:55

Virtex6内部错误的解决办法？

adolclistin

用户通信论坛将无法为您提供帮助。您需要在此问题上打开一个Webcase，为了进行调试，您需要提供HDL代码。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx ...
回答了问题 2020-6-3 14:44

如何直接使用LVCMOS25接口而不是使用电平转换器来处理来自FPGA的信息位到DAC

lan876

对Virtex-6数据表的干涉存在误解。 Voh（min）和Vol（max）数字是保证Ioh和Iol电流的电压点。例如，如果使用带有12mA驱动的LVCMOS25，那么在Vcco-0.4（2.1V）的Voh时，12mA的电流将能够由输出缓冲器提供。如果负 ...
回答了问题 2020-6-3 14:36

在配置的Virtex-5上进行边界扫描时出现问题怎么办

A一伟到A

使用ICMANDARD的LVCMOS33，LVCMOS25，LVCMOS18，LVCMOS15或LVCMOS12（适用于连接到IO所在组的VCCO）应与未配置状态下的工作方式相同。然而，你的问题和经验有点奇怪。如果您的系统要求设计需要一个唯一的IO标准才 ...
回答了问题 2020-6-3 14:13

在配置的Virtex-5上进行边界扫描时出现问题怎么办

A一伟到A

配置器件时，IO配置为位文件中指定的IO标准，而在未配置状态下，它们将类似于某种形式的LVCMOS @ VCCO标准。如果配置了LVDS标准，则其行为与取消配置时的行为方式不同。对于成为VREF或VRN / VRP的IO也是如此。 --- ...
回答了问题 2020-6-3 13:43

ML401/ML402/ML403评估平台针脚的用途是什么？

wufengju

ML40x电路板是在Virtex-5系列产品生命周期的早期ES阶段开发的。当这些设备投入生产时，删除了一个名为System Monitor的功能，并更新了文档以反映这一点。 http://www.xilinx.com/support/answers/20102.htm 请遵循u ...
回答了问题 2020-6-3 12:58

IOStandard分配给ucf这些引脚将使用什么逻辑系列？

楼丞紫澈

查看设计的引脚分布报告文件，它将显示所有IO引脚的结果。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com ...
回答了问题 2020-6-3 11:59

如何进行时序收敛，即如何确保生成的内核工作在2.5GHz

亲爱的娜娜

>我只使用完整的GTP双核心中的Serializer和Deserializer。您将使用的不仅仅是这两个块。 >串行器的输入为10位（@ 250MHz），输出为1个串行位（@ 2.5GHz）。同样，它将是1位@ 2.5 Gbps，设备中的任何设备都不会以2. ...

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