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李森

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他的提问 41 他的回答 999 去回答

回答了问题 2020-6-16 15:51

如何将LvCmos 2.5 i / o转换为Fpga内的差分信令（Lvds）吗？

Green_LJ

>我需要一些将LVCmos电平电压转换为Lvds格式的东西，以便我可以 >使用GTX收发器将数据传输到fpga之外这没有意义。您可以拥有一个单端IO输入缓冲器，并配置为LVCMOS18，LVCMOS25，LVCMOS35。您可以将差分输出缓冲 ...
回答了问题 2020-6-16 15:46

如何将数据从pc发送到fpga？

artman66

>我有点困惑从哪里开始开始的地方是你的电脑。您的PC可以使用哪些接口与之通信？在哪些接口中哪一个最适合您计划发送/接收的数据类型？ ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多 ...
回答了问题 2020-6-16 15:40

如何将数据从pc发送到fpga？

artman66

以太网是以太网，如果你的PC只支持10/100到RJ45那么这就是你可以得到的所有，你不能超频协议。我不了解您正在使用的Labview板，也无法评论它是如何使用的。 ------您是否尝试在Google中输入问题？如果没有，你应该 ...
回答了问题 2020-6-16 14:30

如何在virtex 5 xupv5-lx110t上出现外部时钟信号故障?

hsdfss

XC5VLX110T-FF1136的AN33引脚不是时钟引脚（GC或CC），因此您会收到此警告。您需要将输入移至GC或CC引脚以使用专用时钟路径，如果输入是单端，则必须将其置于差分对的P侧。如果无法移动引脚位置，则必须设置ERROR ...
回答了问题 2020-6-16 10:01

FPGA上LVDS接收器的速度是否会降低？

thyysbk

是的，您是正确的，数据表确实说用于LVDS的Vicm为0.3-1.425V，并且在外部100ohm终端电阻的范围内性能相同。使用Vicm = 600mV的内部DIFF_TERM功能会对链路的信号完整性产生重大影响，从而降低性能。 ------您是否尝 ...
回答了问题 2020-6-16 09:38

FPGA上LVDS接收器的速度是否会降低？

thyysbk

不幸的是，在数据表条件之外的操作没有速度降额，IBIS中的模拟将无法提供操作的洞察力。为了在600mV下实现最佳工作，不应使用内部DIFF_TERM，因为它针对1.25V共模进行了优化，而在每个接收器的PCB上都包含100欧姆差 ...
回答了问题 2020-6-15 16:46

所有VIRTEX-6的半导体安装技术，是倒装芯片安装技术的芯片吗

xiuyuan56789

XAPP427记录了无铅器件的焊接要求 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com 在原帖中查看解决方案 ...
回答了问题 2020-6-15 15:57

系统监视器Virtex-5行为问题如何解决

chm12

请放一张表格，显示系统监控温度和在封装盖中心测量的外壳温度，以获得不同功耗范围。每个工作点和温度测量之间应至少保持2分钟，以确保其稳定。此外，您需要记录您正在使用的零件/包装组合。 ------您是否尝试在G ...
回答了问题 2020-6-15 10:48

SLICEM和SLICEL的输出差异怎么回事

cmh26

SLICEL具有仅作为逻辑元件工作的LUT，而SLICEM具有可作为存储器元件工作的LUT。切片的所有其他方面都是相同的。配置为Distrubuted RAM的LUT将始终具有同步写入和异步读取。来自LUT RAM的读取输出可以直接连接到同 ...
回答了问题 2020-6-15 10:17

错误iMPACT 583-'1'：bsdl文件与从设备读取之间的idcode不匹配怎么回事

ji56789

由于相同的软件和电缆在3个不同的电路板中的2个工作，因此问题在电路板上无法工作。您称之为“project-circuit1”电路板的电路板存在设计方式的问题。我建议您拿出示波器并探测电路板上每个器件的TCK线，看看是否 ...
回答了问题 2020-6-15 09:42

错误iMPACT 583-'1'：bsdl文件与从设备读取之间的idcode不匹配怎么回事

ji56789

这表明电路板上的JTAG链最有可能在TCK（时钟）线上出现信号完整性问题。这导致偶尔从板上读出不正确的数据。 JTAG可能是一个慢速接口，但它与任何其他接口一样容易受到时钟毛刺的影响。 ------您是否尝试在Google中 ...
回答了问题 2020-6-15 09:35

如何从Virtex 5 FPGA输出时钟信号

DDT6

您需要描述在模拟中有效的方法以及无效的方法。有明确定义的问题，人们无法帮助你。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝试添加网站：www.xilinx.com ...
回答了问题 2020-6-15 08:55

如何从Virtex 5 FPGA输出时钟信号

DDT6

这是一个相当简单的任务（在这个主题的论坛中有多个线程）。你说过你没有“运气好”，但对于任何人提供建议都没有足够的描述性。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝 ...
回答了问题 2020-6-15 07:30

如何使用Virtex4和5 UART的RS232电缆引脚图

a732538

您想使用NULL调制解调器样式的电缆连接。如果确实有效，那么如果将RX / TX置于错误的位置，则应更换电缆或设计中的RX / TX引脚。 ------您是否尝试在Google中输入问题？如果没有，你应该在发布之前。太多结果？尝 ...
回答了问题 2020-6-15 07:04

ML605电路板故障如何解决

HNHS

>我只是将2个LED连接到“我的世界”程序和这就是您在设计中所拥有的一切，只有2个输出连接到电路板上的LED？然后请发布这个简单的代码，两个IO位置约束和PAD引脚输出报告文件。 ------您是否尝试在Google中输入问 ...

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