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FPGA开发者技术社区文章

  • 紫光同创FPGA入门指导：数码管静态显示——紫光盘古系列22K开发套件实验教程

    一：实验目的 四位八段数码管同时循环显示数字 0~9。 二：实验原理 数码管是一种半导体发光器件，其基本单元是发光二极管。能显示 4 个数码管叫四位数码 管。数码管按段数分为七段数码管和八段数码管，八段数码管比 ...

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  • 紫光同创PGC1KG-LPG100 / PGC2KG-LPG100开发套件|盘古1K/2K开发套件

    盘古1K/2K 开发套件是基于紫光同创 FPGA 开发平台的开发套件，以紫光同创 Compa系列PGC1KG-LPG100 / PGC2KG-LPG100 器件为核心，预留丰富的扩展 IO 及数码管、 按键、LED 灯，为用户提供基本的硬件环境。 盘古1K/2 ...

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  • FPGA 编程：原理概述

    软硬件工程之间的界限比我们看到的更模糊。称之为现场可编程门阵列 (FPGA) 的器件，其物理属性可通过使用硬件描述语言 (HDL) 来操控，该器件可在软硬件编程之间架起一座桥梁。 但人们通常认为，FPGA 是只能由硬件工 ...

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  • 实验教程：键控彩灯 ——紫光盘古系列高性能入门级2K开发板

    一、实验目的 1 设计 8 种彩灯效果，可通过按键切换。 2 选择一个按键作为控制输入，按下一次换一种显示效果，在 8 种效果中循环。 二、实验要求 1、实验平台：MES2KG 开发板； 2、按键输入由 K1 输入，LED 输出为 L ...

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  • 实验教程：LED 流水灯 ——紫光盘古系列高性能入门级2K开发板

    一、实验目的 掌握流水灯原理并实现流水灯 二、实验要求 流水灯：8 个 LED 以 0.5s 间隔接替闪烁 三、实验原理 相比上一个 LED 闪烁的实现，只需要改变 LED 的状态。将 8 个 LED 灯流水式的点亮；在 C 语言中做流水 ...

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  • Xlinx IP Core实现FFT变换——为什么你的matlab数据无法严格比对？

    一．Xilinx FFT IP介绍 1.总体特性 • FFT IP核支持复数的正逆傅里叶变换，可以实时配置变换的长度 • 变换的长度N=2 ^m^ ,m=3-16,即支持的点数范围为8-65536 • 数据和相位因子宽度都为8-34 • 支持三种算法 ...

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  • 利用IBERT核对GTX收发器板级测试

    一、概述 IBERT（集成误码率测试仪）是xilinx为7系列FPGA GTX收发器设计的，用于评估和监控GTX收发器。IBERT包括在FPGA逻辑中实现的模式生成器和检查器，以及对端口的访问和GTX收发器的动态重新配置端口属性，还包括 ...

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  • Xilinx大神都懂的数字运算单元—DSP48E1

    FPGA中DSP资源是宝贵的且有限，我们在计算大位宽的指数、复数乘法、累加、累乘等运算时都会用到DSP资源，如果我们不了解底层的DSP特性，很多设计可能都无法进行。逻辑综合往往是不可控的，为了能够充分利用DSP资源， ...

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  • 为什么要用傅里叶变换？FFT你不知道的细节

    1.FFT变换的基本原理 傅立叶变换是数字信号处理领域一种很重要的算法，可以将一个信号从时域变换到频域。傅立叶原理表明：任何连续测量的时序或信号，都可以表示为不同频率的正弦波信号的无限叠加。 根据原信号 ...

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  • 从零开始学习紫光同创FPGA——PGL22G开发板之数码管动态显示（五）

    一、数码管动态显示 1、实验目的 在数码管静态显示的基础上让数码管各个位显示不同的数字，即学会以动态驱动的方式驱动四位八段数码管。 2、实验要求 使用4个按键分别控制4个数码管显示0~9的数字，按键每次按下后显 ...

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  • 实验教程：控制LED灯——紫光盘古系列高性能入门级2K开发板

    一、 实验目的 实现对多LED灯的控制; 二、 实验要求 控制8个LED以1s的周期闪烁（0.5s亮，0.5s灭） 三、实验原理 通常的时，分，秒的计时进位大家应该不陌生； 1小时=60分钟=3600秒，当时针转动1小时，秒针跳动3600次 ...

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  • 紫光同创FPGA入门指导：OV5640 双目摄像头——紫光盘古系列50K开发板实验教程

    一、MES50HP 开发板简介 MES50HP 预留 1 个 2.54mm 标准间距的 40 针的扩展口 J8，用于连接各个模块或者用户自己设计的外面电路，扩展口有 40 个信号，其中，5V 电源 1 路，3.3V 电源 2 路，地 3 路，IO 口 34 路。 ...

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  • FPGA实现MPU6050姿态解算

    一. 简介 在之前的文章中(很久之前了，已经通过FPGA获取到了MPU6050的六轴数据: 三轴加速 和 三轴角速度，但是没有对它进行然后处理。那么在本篇文章中，将利用Cordic算法来进行姿态解算。 二. 踩坑分享 在进行姿态 ...

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  • 【小眼睛科技紫光盘古50K开发板试用体验】试用报告一：开箱+初体验 attach_img

    本帖最后由 AlvinGG 于 2023-5-15 11:15 编辑 紫光盘古系列50K开发板  (MES50HP）是深圳市小眼睛科技有限公司为集创赛、全国FPGA竞赛官方定制的开发板，看到电子发烧友论坛上提供的试用机会，我迫不及 ...

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  • 紫光同创FPGA入门指导：DDR3 读写——紫光盘古系列50K开发板实验教程

    MES50HP 开发板简介 MES50HP 开发板集成两颗 4Gbit（512MB）DDR3 芯片,型号为 MT41K256M16。DDR3 的总线宽度共为 32bit。DDR3 SDRAM 的最高数据速率 800Mbps 一、实验要求 生成 DDR3 IP 官方例程，实现 DDR3 的读写 ...

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    本帖最后由 mameng 于 2024-9-7 16:17 编辑 1

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  • 【小眼睛科技紫光盘古50K开发板试用体验】+开箱体验

    小眼睛FPGA是一家以FPGA为核心的设计公司。团队创始人及创始骨干在FPGA领域拥有超过10年的深厚行业经验和技术积累。擅长各种基于FPGA的工业应用，无线通信应用。 这次有幸收到了盘古50开发板，开启试用体验之旅。 ...

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  • 什么是良好的Verilog代码风格？

    1、前 言 之前在公司负责制定代码规范，费了九牛二虎之力，终于整理出来一份文档。由于保密规定的缘故，无法与大家直接分享这份文档。但是，文档中的大部分规范都是我自己长期总结出来的，在这里也与大家分享一下。 ...

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  • 高级FPGA设计技巧！多时钟域和异步信号处理解决方案

    有一个有趣的现象，众多数字设计特别是与FPGA设计相关的教科书都特别强调整个设计最好采用唯一的时钟域。换句话说，只有一个独立的网络可以驱动一个设计中所有触发器的时钟端口。虽然这样可以简化时序分析以及减少很 ...

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  • VerilogHDL 可综合设计的注意事项

    一、逻辑设计 （1）组合逻辑设计 下面是一些用Verilog进行组合逻辑设计时的一些注意事项： ①组合逻辑可以得到两种常用的RTL 级描述方式。第一种是always 模块的触发事件为电平敏感信号列表；第二种就是用assign 关 ...

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  • 干货 | 拆解FPGA芯片，带你深入了解其原理

    现场可编程门阵列（FPGA）可以实现任意数字逻辑，从微处理器到视频生成器或加密矿机，一应俱全。FPGA由许多逻辑模块组成，每个逻辑模块通常由触发器和逻辑功能以及连接逻辑模块的路由网络组成。FPGA的特殊之处在于它 ...

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  • FPGA初学者：分析FPGA仿真验证知识

    简介 本系列文章主要针对FPGA初学者编写，包括FPGA的模块书写、基础语法、状态机、RAM、UART、SPI、VGA、以及功能验证等。将每一个知识点作为一个章节进行讲解，旨在更快速的提升初学者在FPGA开发方面的能力，每一个 ...

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  • 一文教你如何区分FPGA与DSP特点及用途

    FPGA是一种可编程的，DSP是，当系统设计人员在项目的架构设计阶段就面临到底采用FPGA还是DSP的重要问题。本文将首先分别介绍FPGA和DSP的特点，然后再从内部资源、编程语言、功能多个角度解析两者的不同。 1、FPGA与D ...

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  • 紫光同创FPGA入门指导：DDR3 读写——紫光盘古系列50K开发板实验教程

    一、实验要求 生成 DDR3 IP 官方例程，实现 DDR3 的读写控制，了解其工作原理和用户接口。 二、DDR3 控制器简介 PGL50H 为用户提供一套完整的 DDR memory 控制器解决方案，配置方式比较灵活，采用软核实现 DDR memor ...

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  • FPGA工作原理与简介

    FPGA是在PAL、GAL、EPLD、CPLD等可编程器件的基础上进一步发展的产物。它是作为ASIC领域中的一种半定制电路而出现的，即解决了定制电路的不足，又克服了原有可编程器件门电路有限的缺点。由于FPGA需要被反复烧写，它 ...

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  • FPGA

    FPGA设计不是简单的芯片研究，主要是利用 FPGA 的模式进行其他行业产品的设计。 与 ASIC 不同，FPGA在通信行业的应用比较广泛。通过对全球FPGA产品市场以及相关供应商的分析，结合当前我国的实际情况以及国内领先的F ...

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  • FPGA学习及设计中的注意事项

    1.基础问题 　　FPGA的基础就是数字电路和HDL语言，想学好FPGA的人，建议床头都有一本数字电路的书，不管是哪个版本的，这个是基础，多了解也有助于形成硬件设计的思想。 在语言方面，建议初学者学习Verilog语言，VH ...

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  • 【小眼睛科技紫光盘古50K开发板试用体验】之：流水灯测试和Modelsim联合仿真 attachment

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  • 【小眼睛科技紫光盘古50K开发板试用体验】+高速ADC模块硬件连接

    这次幸运的申请到盘古50K开发板，收到板后就开始了紧张的测试，希望能使用这块开发板，实现200M的高速ADC示波器功能。 首先看我的ADC采集硬件结构 高速ADC采集板，是自己画的一个板子，以前是用来适配一款小眼睛FPGA ...

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  • 今日说“法”：是谁动了我的JTAG口？ attach_img

    欢迎大侠来到FPGA技术江湖新栏目今日说“法”，当然，在这里我们肯定不是去研究讨论法律法规知识，那我们讨论什么呢，在这里我们讨论的是产品研发以及技术学习时一些小细节小方法等，欢迎大家一起学习交流，有好的 ...

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