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[问答]

KL25 SPI从机中断接收丢数据的问题

使用KL25开发板,作SPI slave,时钟4.2Mhz,收发通过SPI中断完成。现在调试发现主机发过来的数据,从机丢包严重,接收2-3个字节就可能丢一个,时钟降到2MHz就没有此问题,请问4.2MHz的时钟太高了吗?还是SPI中断已经不够快了,通过DMA会有改善吗?主设备SPI的频率4MHz多。
注:通过示波器看过波形,主机发送没有问题
诚求大虾指点

回帖(6)

刘洋

2014-12-31 15:23:47
请问你是在中断函数中,才读取收到的数据吗?
如果是这样的话,应该可以解释,用示波器观察到的数据是正确,而实际收到的数据有丢包的现象。
还有关于你想利用DMA增加读取收到数据的速度而避免丢包,我觉得应该是可行的,值得一试!
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莎莎miu~

2014-12-31 15:24:12
引用: LY0206 发表于 2014-12-31 15:23
请问你是在中断函数中,才读取收到的数据吗?
如果是这样的话,应该可以解释,用示波器观察到的数据是正确 ...

是的,在中断函数中读取的,进一次读一个,我很奇怪哦,为什么这样也会丢,也不算是特别快把,可否详细解析?
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刘高

2014-12-31 15:33:05
看一下手册吧!描述了从模式下,各种时序的要求。
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莎莎miu~

2014-12-31 15:33:26
引用: ccly0208 发表于 2014-12-31 15:33
看一下手册吧!描述了从模式下,各种时序的要求。

谢谢你的回复,我觉得还是在中断函数中读取数值过程,新的数据已经传送到MCU了,从而导致丢包的可能性大一点。
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suyong_yq

2015-1-7 00:23:35
有一个情况也需要考虑,在实际测试的时候,SPI通信线路过长也是一个因素。我见过有朋友做测试的,长20cm的杜邦线连接同一块板子上的SPI主从机,速度比较快的时候就错相了。
不过你那个问题可能是中断没有处理过来,如果是KL25的话,典型的bus clock 24MHz,core clock 48MHz,中断里内容稍微多一点就搞不定4M的通信波特率了。
但是,你仍然可以通过提高编译器的优化级别试一下,效果还是比较明显的,估计多少能缓解一下丢包的情况。最后,测试程序设计不合理可能也会影响。如果用UART串口输出显示,串口的波特率很低,可能会丢掉一些数据不能显示,而如果是用JLink看的话,有些寄存器被JLink一读,标志位就没了,自然就存不到程序里。
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胡克

2016-8-6 14:38:59
谢谢楼主了,十分感谢,赞一个。
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