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DAC81402输出两个点的时间间隔,最短多少?


  • 输出两个点的时间间隔,最短多少?
    我看时钟是50MHz

回帖(2)

韩刚龙

4 天前

您好,

输出两个点的时间间隔也就是更新时间,它是由数字接口的更新时间(update time)或

稳定时间( settling time)决定,哪个时间长由哪个决定。

计算数字接口的更新时间:

假设

SPI SCLK 的时钟频率为50MHz,根据Figure

7-1时序图,更新一个24bits的样本,需要的最小时间为tCSHIGH+tCSS+23tsclk+tCSH=505ns;

DAC81402的 settling

time如下截图,给出的是 DAC 从1/4
全刻度范围步进至3/4*全刻度 的稳定时间, 这不是最快的稳定时间。如果 DAC 仅步进1

LSB,则更新时间会更短,因为 DAC 的小信号稳定速度要快得多。它同时与负载电容CL有关,CL越大settling time越长;可以看出 其settling

time是us级的,

因此,DAC81402的更新时间不受数字接口的限制,而是取决于稳定时间:


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听风说梦

4 天前
DAC81402 是一个 12 位的数字模拟转换器(DAC),具有高速更新功能。为了计算最短的时间间隔,我们需要考虑几个因素,包括时钟频率、DAC 的更新速率和数据缓冲区。

1. 时钟频率:您提到的时钟频率是 50MHz,这意味着 DAC 每 20ns(1/50MHz)接收一个时钟信号。

2. 更新速率:DAC81402 的最大更新速率是 40Msps(百万次每秒)。这意味着 DAC 可以在每 25ns(1/40Msps)更新一次输出值。

3. 数据缓冲区:DAC81402 具有一个 16 位的数据缓冲区,可以存储两个 12 位的数据值。这意味着在输出第一个数据值后,DAC 可以在下一个时钟周期输出第二个数据值,而不需要等待更新速率的限制。

综合以上因素,我们可以得出 DAC81402 输出两个点的最短时间间隔。由于数据缓冲区的存在,我们可以在每 20ns(时钟周期)输出一个数据值。因此,最短的时间间隔是 20ns。
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