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张义

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[问答]

运放交流耦合电路分析

先上图。
运放分析图.png
公式1.png
其中 Z1 为 C1 和 R1 串联后的阻抗,Vdc为输入信号Vin中的直流分量。我想知道Vout的计算公式是怎么得来的,这公式前面这部分
公司2.png看起来像同相放大,
反向.png后面这部分看起来像反相放大,难道最后2个相加即可?
请大家帮忙分析分析,谢谢啦。

回帖(1)

烟台FPGA

2022-10-5 21:55:00
假定运放OPA735的输入阻抗很高,即4脚的输入电流很小,可以不考虑。从VF1开始,经过电容C1、电阻R1和R2,到VOUT.属于串联电路,电流不变。运放的同相输入和反相输入的电位相等,都是VREF.可以列出式子:(VF1  -  VREF ) / Z1 = ( VREF - VOUT) /R2.其中,Z1 是电容C1和电阻R1串联之后的阻抗。
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  • 张义: 我计算出来的结果是:

    vo=((r2 + z1)/z1)*vref - (r2*vdc + r2*vi)/z1
    前面那部分没问题,后面这部分不一样,是除以z1,而原图是除以R1的?
    这是为什么?
  • 烟台FPGA 回复 张义: 笔误吧,不必多虑。
  • 张义 回复 烟台FPGA: 好的,了解了

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