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张宁

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[问答]

如何创建一个具有200MHz输入和640MHz,160MHz输出的时钟发生器?

我正在使用planahead 14.4在VC707上添加7系列MIG(IP版本1.07a)。当我使用第一个具有200MHz振荡器输入的时钟发生器驱动MIG时,我的设计可以完全路由,我尝试使用100MHz
系统时钟和200MHz系统时钟,它们都还可以。但是当我想使用160MHz作为系统时钟时,我无法创建一个具有200MHz输入和640MHz,160MHz输出的时钟发生器,所以我使用两个时钟
发电机产生这些频率而不是驱动MIG。
我的设计现在变得没有了!
但是我的总利用率变化很低,只有20%。我不知道会发生什么情况会导致这条未被发布的消息?顺便说一下,我选择了“-x”选项忽略时间约束时合成和实现。

回帖(8)

石俊梅

2020-8-11 10:16:06
你好@ eggmilkttl
检查原理图,看看是否在通过设计的CLKOUT上插入了任何缓冲区,如BUFG,并且在设计失败时不存在。
谢谢,迪皮卡.----------------------------------------------
---------------------------------------------- Google之前的问题
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张鑫

2020-8-11 10:31:11
这些输出频率具有相同的设置,时钟组PLLE0,缓冲区= FALSE。谢谢!
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赵雪培

2020-8-11 10:39:14
因此,路由由时序约束驱动。
如果你忽略了你所说的时序约束,那么路由可能会受到影响,因为改变是设计,即有2个时钟发生器,而不是1.请指出没有路由的确切网络,以便它应该更容易
指出问题。
谢谢,AnirudhPS:请将此标记作为答案,以防它有助于解决您的问题。如果帖子引导您找到解决方案,请给予赞誉。
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石俊梅

2020-8-11 10:45:15
你好@ eggmilkttl
你能上传工作失败的设计的NCD和PCF文件吗?
谢谢,迪皮卡.----------------------------------------------
---------------------------------------------- Google之前的问题
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