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[问答]

为什么CLKbe T不能接线?

对于带有2xDDR3组件的Z7015,我在“T-配置”中路由了地址线。
UG933,表5-12表示CLK总是2个或更多组件的飞越。
根据UG933混合拓扑听起来很不寻常。
为什么CLKbe T不能接线?
如果必须的话,对于CLK和CKE的长度匹配要求应该说些什么?
谢谢!

回帖(1)

张颖

2020-3-25 10:08:15
以下Design Asistant AR#http://www.xilinx.com/support/answers/51475.html适用于7系列FPGA。
但是大多数概念也适用于Zynq。
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