Xilinx FPGA中的IO标准(包括HSTL)按照JDEC标准设计。
所以适用于Spartan-6的所有标准规格也都适用。
HSTL IO标准的最大速度/性能不仅取决于标准,还取决于定制电路板物理特性(迹线长度,宽度,厚度,介电特性等)。
因此,由于最终用户板/ PCB设计依赖性,我们不会在文档中指定最大速度。
这在http://www.xilinx.com/support/answers/12866.htm中指定,概念也适用于所有FPGA器件
客户在此问题上的工作是使用IBIS模型和电路板传输线模型进行信号完整性(SI)仿真。
XILINX为此提供了IBIS模型。
通过按照他的电路板设计使用IBIS仿真,客户甚至可以在设计之前获得速度和其他SI结果。
您可以从以下链接下载Spartan-6 IBIS型号:https://www.xilinx.com/support/download/index.html/content/xilinx/en/downloadNav/device-models/ibis-models/spartan-series
-fpgas.html
以下链接文档和培训材料中的信息有助于理解和进行SI模拟
http://www.xilinx.com/products/technology/signal-integrity.html
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Xilinx FPGA中的IO标准(包括HSTL)按照JDEC标准设计。
所以适用于Spartan-6的所有标准规格也都适用。
HSTL IO标准的最大速度/性能不仅取决于标准,还取决于定制电路板物理特性(迹线长度,宽度,厚度,介电特性等)。
因此,由于最终用户板/ PCB设计依赖性,我们不会在文档中指定最大速度。
这在http://www.xilinx.com/support/answers/12866.htm中指定,概念也适用于所有FPGA器件
客户在此问题上的工作是使用IBIS模型和电路板传输线模型进行信号完整性(SI)仿真。
XILINX为此提供了IBIS模型。
通过按照他的电路板设计使用IBIS仿真,客户甚至可以在设计之前获得速度和其他SI结果。
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