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杨兵
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fpga ad9959配置不成功
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FPGA
AD9959
配置时数据写不进去，SYNC—CLK一直是基频的１／４，板子没问题，ｃｓ和SCLK的时序没问题，update和ＳＹＮＣ－ｃｌｋ怎么同步？有什么要求？
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