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[问答]

如何导入鹰电路设计

你好，
我用eagle软件完成了电路设计（en / de）/原理图，我想在（免费）xilinx工具链中编辑，所以我可以用我的斯巴达6 FPGA  - 我怎么做？我不这样做
想要点击一下再点击，因为这需要花费数月的时间 - 数据已经存在且工作正常，但是在这个eagle-cad软件中 - 我如何让我进入你的？
我需要什么？
有一个名为'netlist'的.txt文件，我可以导出，我认为这会有所帮助，但我不知道在哪里将它导入到web-ise 13.3  - 我尝试了一些放置（项目导航器等）但是那里
没有办法再次看到原理图（在xilinxsoftware中） - 你能帮忙吗？！
谢谢！我在这里的（德语）论坛上也发了这个问题。
谢谢你的时间和
想法！奥利弗

以上来自于谷歌翻译


以下为原文

hello,

I have a circuit design done with eagle software (en / de)  / schematic like this that I would like to edit in the (free) xilinx tool chain so I can use it with my spartan 6 fpga - how do i do that?

I don't want to redraw it click by click because that would take months of work - the data is already there and working, but in this eagle-cad software - how do I get i into yours? what do I need? there is a .txt file called 'netlist' that I can export, I thought that would help, but I didn't know where to import it into the web-ise 13.3 - I tried some placed (project-navigator etc) but there was no way to see the schematics again (in the xilinx software) - could you please help?! thanks!  

I posted this question also in their (german) forum here.

thanks for your time & ideas!
oliver

回帖（7）

李欣海

2019-2-22 10:05:40
我如何编辑自己的帖子？
无论如何：这是一个.sch格式的例子，我的设计保存在......

以上来自于谷歌翻译


以下为原文

how do I edit my own posts here?
 
anyway: here is an example of the .sch format my design is saved in...
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杨玲

2019-2-22 10:15:26
目前尚不清楚你要做什么。
这是一个板级原理图，还是一个进入FPGA的逻辑原理图。
Xilinx工具链仅适用于FPGA内部的逻辑，而不适用于板级设计。
一些原理图编辑器可以以EDIF或结构VHDL格式导出网表。
Xilinx后端工具可以使用其中任何一个来编译设计。
无法将图形化原理图直接导入Xilinx原理图。
-  Gabor
PS新用户可能无法在某个介绍期间编辑自己的帖子。
添加此项是为了减少此论坛上的垃圾邮件帖子。
在此期间，请按照您的要求继续回复您自己的帖子。
当您超过介绍期后，您应该开始在“选项”菜单中看到“编辑回复”。
-  Gabor

以上来自于谷歌翻译


以下为原文

It's not clear what you're trying to do.  Is this a board-level schematic or is it a schematic of the logic that goes into the FPGA.   The Xilinx tool chain is only for the logic inside the FPGA, not the board-level design.  Some schematic editors can export a netlist in EDIF or structural VHDL format.  Either of these can be used by the Xilinx back-end tools to compile the design.  There is no way to directly import a graphical schematic into the Xilinx schematics.
 
-- Gabor
 
PS  New users may not edit their own posts for a certain introductory period.  This was added to reduce spam posts on this forum.  In the meantime go ahead and reply to your own posts as you have done.  When you have past the introductory period, you should start to see "Edit Reply" in the Options menu.
-- Gabor
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陈舒斌

2019-2-22 10:23:59
嗨，
你是否想要在FPGA-Talk上发布c64模拟器？
您具有相同的用户名。
无论如何...
即使您只有数字部件的鹰图，这些名称也不会与Xilinx原理图符号名称相匹配，因此即使转换它也无济于事。
（除了这两种格式之间可能没有转换器这一事实）
所以你需要再次绘制原理图，如果它有用的话。
也许某些HDL描述会在更短的时间内提供更好的结果，具体取决于您要创建的硬件。
有一个很好的综合 
Eilert

以上来自于谷歌翻译


以下为原文

Hi,
are you the same guy that wants tu build the c64 emulator as posted on FPGA-Talk?
You have the same user name.
 
Anyway...
 
Even if you have some eagle schematic with just digital parts, the names wont match the Xilinx schematic symbol names so even converting it wouldn't help. (Besides the fact that there probably is no converter between these two formats)
 
So you need to draw the schematics again, if that is useful at all.
Maybe some HDL description gives better results in less time, depending on the hardware you want to create.
 
Have a nice synthesis
  Eilert
 
 
 
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李欣海

2019-2-22 10:37:09
“一些原理图编辑器可以导出EDIF或结构VHDL格式的网表.Xilinx后端工具可以使用其中任何一个来编译设计。”
再一次问好
哪里？
我在哪里可以导入这些网表（如果他们有正确的格式）
我自己找不到它......
thanx你的答案！
奥利弗

以上来自于谷歌翻译


以下为原文

"Some schematic editors can export a netlist in EDIF or structural VHDL format.  Either of these can be used by the Xilinx back-end tools to compile the design."
 
hello again
 
where?
where can I import these netlists (in case they do have the right format)
I couldn't find it it myself...
 
 thanx for your answer !
oliver
 
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