至芯科技FPGA培训入门视频下载

FPGA

` 本帖最后由小墨学FPGA 于 2016-1-21 16:06 编辑

至芯科技作为全国最专业的FPGA人才培养基地，Altera ATPP (Altera Training Partner Program) 主力成员，长期从事Altera 的培训,尤其注重大学计划。至芯科技致力于整合FPGA的教学资源，为高校提供完整的FPGA教学体系、提供最新的FPGA使用工具、提供最新的FPGA教学仪器、提供最实用的FPGA教学教程。积极培养新生代FPGA人才，更积极推进校企合作，努力使Altera----至芯----高校三方形成一个稳定的FPGA生态系统，培养出更多卓越的FPGA工程师。近期结合Altera的产品更新,在嵌入式, SoC方面也能为广大师生提供服务，至芯期待在更广的领域与更多的高校合作与发展！

至芯李老师
资深IT专家，原地矿部CV计算机协会理事，曾任大型国企（深圳某计算机公司）副总工程师，中国第一个MIS（信息管理系统）的创始人之一，中国第一代彩色LED显示屏的主要研发者之一，国内最早的《九连环与格雷码》的科学技术史研究者，担任过载波通信、视频处理、图像加速、密码学项目、LVDS项目，激光项目，LED显示屏项目等项目的课题负责人。
            具有的丰富的FPGA应用实践经验和理论成果，具有较强的教学能力。

至芯科技FPGA入门视频下载地址：
从原理图到HDL
FPGA的发展和展望
Verilog模块的设计流程
设计一个十六位的加法器
FPGA的设计原则和技巧01
FPGA的设计原则和技巧02
IP核的使用
Verilog HDL的建模
D型触发器的verilog代码和Testbench的编写
BCD码编码器_逐步移位法
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zxopen01 · 2015-11-28 11:34:04

{:1:}{:1:}

zxopen88 · 2015-11-30 09:48:23

ALTERA fpga芯片生产商

罗绍锋 · 2015-12-1 10:26:53

这种好东西就应该珍藏！1

zxopen88 · 2015-12-1 11:06:27

如何设计testbench文件
http://www.fpgaw.com/thread-84041-1-1.html
verilog 设计经典例程
http://www.fpgaw.com/thread-84065-1-1.html
altera niosii从入门到精通
http://www.fpgaw.com/thread-84066-1-1.html
DDR2 规范中文版
http://www.fpgaw.com/thread-84067-1-1.html

沈歆耘 · 2015-12-1 20:56:01

学习收藏

zxopen88 · 2015-12-2 10:14:27

FPGA设计流程中，逻辑综合的过程非常重要。

南盗 · 2015-12-2 21:06:24

小墨现在在做什么啊？

zxopen88 · 2015-12-3 11:07:58

夏宇闻老师写的verilog数字验证与设计一书看看

longmaxingkong · 2015-12-3 15:19:04

好东西啊正要学习找不到好的资料啊！！！

dsp8001 · 2015-12-4 10:40:27

感谢分享，已下载，有空学习下。

王志睿 · 2015-12-4 14:35:08

已收藏，多谢，以后不定会用到！

学习FPGA · 2015-12-6 22:15:18

真的很不错感觉非常好

zxopen88 · 2015-12-7 10:40:08

根据摩尔定律（每2年晶体管密度就会翻1倍），晶体管会越来越便宜，因此它就越来越常见。接下来的几年里，就出现了数十亿美元的现场可编程门阵列（FPGA）市场，为 Xilinx 的成功打下了基础。1989年 Ross Freeman 去世。然而，他发明的技术呈现一派欣欣向荣的景象，并且继续在不断发展的行业中鼓舞着用户。

zxopen88 · 2015-12-8 10:42:07

数字逻辑设计，一项很高大上的技术，相较于软件设计，数字逻辑设计要更加底层，更加的注重每一个时钟的细节。FPGA，一个新生的高科技宠儿。虽然是80年代才面世，但经过30多年的发展，技术已经相当成熟，应用也十分广泛，从航空航天到军工到民用，甚至消费电子，FPGA无处不在。从今年因特尔斥巨资收购世界最大FPGA厂商之一的Altera就可以看出，未来，FPGA将具有更加广阔的应用。

shihaolei7347 · 2015-12-8 22:12:17

好资料，先收藏为敬

zxopen88 · 2015-12-9 10:33:24

所谓综合就是将较高级抽象层次的描述转化成较低层次的描述。综合优化根据目标与要求优化所生成的逻辑连接，使层次设计平面化，供FPGA布局布线软件进行实现。就目前的层次来看，综合优化（Synthesis）是指将设计输入编译成由与门、或门、非门、RAM、触发器等基本逻辑单元组成的逻辑连接网表，而并非真实的门级电路。真实具体的门级电路需要利用FPGA制造商的布局布线功能，根据综合后生成的标准门级结构网表来产生。