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电子发烧友论坛
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我在这个问题上摸不着头脑！
这是一个带有单个差分对输入的小型测试用例设计。 这是错误消息： Pack：1107 - Pack无法将下面列出的符号组合到单个IOB18组件中，因为所选的站点类型不兼容。 进一步说明：组件类型由逻辑类型及其包含的逻辑的属性和配置决定。 在这种情况下，选择了IOB18类型的IO组件，因为IO包含符合单端I / O使用和IOSTANDARD = LVDS属性的符号和/或属性。 请仔细检查逻辑元素的类型及其所有相关属性和配置选项是否与约束的物理站点类型兼容。概述：涉及的符号：SlaveBuffer符号“lclk_ibuffer / SLAVEBUF.DIFFIN”（输出信号= lclk_ibuffer / SLAVEBUF .DIFFIN）PAD符号“DOWNLINK_DATA_N”（填充信号= DOWNLINK_DATA_N）涉及的组件类型：涉及的IOB18Site位置：涉及的P19Site类型：IOB33S 我使用的是ISE 14.6 目标设备是CLG400封装的Zynq7020。 我为这个项目创建了一个新文件夹，只复制.UCF和.V文件。 文件夹中的旧文件不应该有任何垃圾。 .UCF和源代码文件都附加了...... - 鲍勃埃尔金德 签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。 阅读手册或用户指南。 你读过手册了吗？ 你能找到手册吗？2。 搜索论坛（并搜索网页）以寻找类似的主题。 不要在多个论坛上发布相同的问题。 不要在别人的主题上发布新主题或问题，开始新的主题！5。 学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。 提供有用的详细信息（请与网页，数据表链接）.7。 您的代码中的评论不需要支付额外费用。 我没有支付论坛帖子的费用。 如果我写一篇好文章，那么我一无所获。 downlink2.ucf 1 KB downlink_rx.v 12 KB 
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6个回答
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您在IBUFDS输入上使用DIFF_TERM = TRUE。
这需要HR库中的2.5V VCCO，但LVCMOS33在同一个库中。 尝试将此设置为FALSE。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com 在原帖中查看解决方案 |
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我认为您正在尝试使用GTX1专用硬块引脚连接到这个通用用法，因此该工具推出了一个错误，说它不可能将符号组合起来将它们打包到IOB，因为它们是专用的I / O.
这些LOC'ed IO是特定于MGT的。 谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”，以防它有助于解决您的查询。如果一个帖子引导到解决方案，请给予赞誉。 |
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我认为您正在尝试使用GTX1专用硬块引脚连接到这个通用用法，因此该工具推出了一个错误，说它不可能将符号组合起来将它们打包到IOB，因为它们是专用的I / O.
这些LOC'ed IO是特定于MGT的。 请提供此断言的参考。 这些引脚 - N18和P19 - 在UG865中列为多用途（MRCC）引脚。 如果我删除.UCF文件中的LOC引脚分配，我会收到这两条错误消息（在ISE 14.6和ISE 14.7中）： Pack：2503 - 此特定设备不支持“IOB18”组件。 因此，设计将不适合特定设备。 请选择支持此功能的设备，或从设计中删除此组件的所有实例。 地图：237 - 设计太大，无法容纳设备。 请查看“设计摘要”部分，了解设计的哪个资源要求超出了设备中可用的资源。 请注意，报告的切片数量可能无法准确反映，因为它们的包装可能尚未完成。 - 鲍勃埃尔金德 签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。 阅读手册或用户指南。 你读过手册了吗？ 你能找到手册吗？2。 搜索论坛（并搜索网页）以寻找类似的主题。 不要在多个论坛上发布相同的问题。 不要在别人的主题上发布新主题或问题，开始新的主题！5。 学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。 提供有用的详细信息（请与网页，数据表链接）.7。 您的代码中的评论不需要支付额外费用。 我没有支付论坛帖子的费用。 如果我写一篇好文章，那么我一无所获。 |
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您可以判断这是否是工具中的错误，或者设备中未记录的“功能”......
通过将所有IOSTANDARD声明从LVDS和LVCMOS33更改为LVDS_25和LVCMOS25，我能够成功编译，即使所有IO都在HR 3.3V IO bank上。 将LVDS_25输入对与LVCMOS33 IO混合不起作用（错误）。 将LVDS输入对与LVCMOS33 IO混合不起作用（原始发布的映射错误） LVDS_33引发有关非法IOSTANDARD分配的错误消息 这是一种解决方法，而不是修复方法。 关于模糊和误导性错误消息的通常评论完全适用。 我将推迟将此线程标记为“已解决”，直到Xilinx的响应确认SW错误或模糊硬件要求/依赖性为止。 - 鲍勃埃尔金德 签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。 阅读手册或用户指南。 你读过手册了吗？ 你能找到手册吗？2。 搜索论坛（并搜索网页）以寻找类似的主题。 不要在多个论坛上发布相同的问题。 不要在别人的主题上发布新主题或问题，开始新的主题！5。 学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。 提供有用的详细信息（请与网页，数据表链接）.7。 您的代码中的评论不需要支付额外费用。 我没有支付论坛帖子的费用。 如果我写一篇好文章，那么我一无所获。 |
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您在IBUFDS输入上使用DIFF_TERM = TRUE。
这需要HR库中的2.5V VCCO，但LVCMOS33在同一个库中。 尝试将此设置为FALSE。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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您在IBUFDS输入上使用DIFF_TERM = TRUE。
这需要HR库中的2.5V VCCO，但LVCMOS33在同一个库中。 尝试将此设置为FALSE。 我希望这是答案，但在将所有IO设置为LVCMOS33或LVDS_25（但不是LVDS）并设置DIFF_TERM = FALSE后，设计将编译完成。 谢谢，艾德！ 在UG471中找到了关键信息（经过扩展搜索！），表1-55，注1： 注：1。 这些标准的差分输入可以放置在VCCO电平与输出所需电平不同的存储体中。 有一些重要的标准需要考虑： 一个。 除非VCCO电压处于输出所需的电平，否则不使用可选的内部差分终端（DIFF_TERM = FALSE，这是默认值）。 [并注意，没有LVDS_33输出IOSTANDARD，只有LVDS（1.8V）和LVDS_25（2.5V） - Bob E] b。 输入引脚上的差分信号满足特定器件系列数据表的推荐工作条件表中的VIN要求。 输入引脚上的差分信号满足特定器件系列数据手册中相应LVDS或LVDS_25 DC规范表中的VIDIFF和VICM要求。 在某些情况下，为了实现这一点，可能需要为交流耦合和直流偏置引脚提供外部电路。 幸运的是，电路板上已经有外部终端电阻。 感谢你指出我正确的方向，埃德。 - 鲍勃埃尔金德 签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。 阅读手册或用户指南。 你读过手册了吗？ 你能找到手册吗？2。 搜索论坛（并搜索网页）以寻找类似的主题。 不要在多个论坛上发布相同的问题。 不要在别人的主题上发布新主题或问题，开始新的主题！5。 学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。 提供有用的详细信息（请与网页，数据表链接）.7。 您的代码中的评论不需要支付额外费用。 我没有支付论坛帖子的费用。 如果我写一篇好文章，那么我一无所获。 |
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