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电子发烧友论坛|
我是一个微观的家伙 - 从来没有做过程序设备。
我的设计是与设备进行微观交谈--8位数据总线和多个控制线。 输出是16到32套“时钟和数据” - 就像SPI一样。 输出模块由并行加载 - 16位移位寄存器组成。 一个4位递减计数器，用于控制移位的位数（8到16）和一个用于驱动移位寄存器的外部时钟。 也是8合1多路复用器。 8 in将是8个不同的时钟 - 如前所述，其中一个被选择用于驱动移位寄存器。 可能需要一个4位串行并行输出移位寄存器来编程多路复用器。 该块重复16至32次。 其他逻辑是一些地址解码，用于在加载移位时判断正在寻址哪个块。 我想要一个5伏的部件 - 如果我必须做3.3V - 那么我必须在输出端添加5v收发器。 1个街区需要多少个门（大约）？ 门的数量是否接近线性关联 - 意味着32个块是一些开销的32倍？ 成交量很低 - 每年100个。 成本低 - 看起来3美元到8美元。 喜欢PLCC。 真的不想要BGA。 这种设计是CPLD还是FPGA设计？ 是否与Xilinx部件匹配良好？ 在此先感谢您的回复。 乔 
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10个回答
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乔，
这听起来像每个细胞可能有20个FF和10个“门”。 因此，最小的FPGA器件非常庞大，最大的CPLD可能就好了。 我建议没有5V部件。 有3.3v部分（Coolrunner II）可能woulkd做得很好。 Austin Lesea主要工程师Xilinx San Jose |
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乔，
在CPLD中，每个逻辑单元都有一个FF。 并且门在FF之前编程。 我认为你应该从一开始就开始，也许去读一些关于这个主题的书，然后学习你能做什么，以及如何去做。 没有人会在这里发布完整的解决方案...... http://www.xilinx.com/cpld/index.htm Austin Lesea主要工程师Xilinx San Jose |
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谢谢 。
我不是在寻找解决方案。 我正在寻找一个关于我需要多大部分的想法，所以在我致力于学习曲线之前，我可以与descrete进行粗略的价格比较。 这就是为什么我解释了设计 - 我希望得到一个回复......每个块都需要aprox逻辑单元。 然后我可以扩展它以查看我的价格点是否得到满足。 如果确实如此 - 那么我会按照建议对这些书进行评论。 在我退休之前，我可以拿起电话花了15分钟与FAE / Apps人一起拿到我需要的所有decidion信息。 我猜那些日子已经过去了。 再次感谢。 乔 |
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乔，
对于今天这么小的问题，你必须找到一个像你提到的那样渴望为你做的人。 今天，人们正在谈论需要数千万门的问题，以及成千上万的设备（他们将购买）。 当你是一家价值数十亿美元的公司时，你倾向于花费数百万美元客户的最大努力。 我为你的问题缺乏热情而道歉，但这并不是让任何人兴奋的事情。 无论如何，我试图帮助每个人，一个学生，或一个有问题数量1的爱好者，到一个有数百个问题的跨国公司，以及数百万台设备。 如果你用线绕板，插座和74HC逻辑芯片来构建你所描述的“旧方式”，它将很快成为一项艰巨的任务。 它适合最小的FPGA这一事实意味着您可以选择以这种方式进行，因为它的开发，调试和测试速度极快，而且成本也不高。 您可能还会考虑使用较旧的5v CPLD设备。 您可能会发现一些较旧的主板和带有免费软件的设备（可能只能在Windows 3.0下运行!!!!），因此您也可能需要找到一台古老的计算机。 无论如何，赛灵思正在劝阻现在停止使用的任何设计，或者废弃的CPLD，所以在这方面让我们感到非常兴奋。 最后，你能用现代的uP做到这一点吗？ Ardino？ 一个基于小闪存的微型？ 如果你能做到这一切，那么你一定应该这样做！ 今天运行在20到800 MHz的小型uP可以在很短的时间内完成大量的工作，甚至可以控制64个单独的两个线端口，就像你描述的那些非常合理的速率一样！ Austin Lesea主要工程师Xilinx San Jose |
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在我退休之前，我可以拿起手机花费15分钟与FAE / Apps人员一起获取我需要的所有决策信息。
我猜那些日子已经过去了。 在我成为一名专业设计师之前，我记得为TTL数据书召集了10位不同的销售代表和经销商（这是在TTL的'辉煌时期'），他们中的大多数都嘲笑我。 在我成为知名消费者/办公产品制造商的专业设计师 - 具有元件选择权限 - 我得到了主动提供的服务，每周从处理器和外围设备制造商设计整个子系统。 我无法计算有多少开关电源控制器制造商每周都要我出去吃午饭。 更不用说当地Xilinx代表每月或每季度的现场餐饮午餐演示（包括但不限于烤宽面条，凯撒沙拉，高档烘焙面包和饼干，瓶装饮料以及非常舒适的沙漠选择）。 我不认为支持的差异是由于我的好看，还是因为它（或者不是）“过去的好时光”。 不，这绝对不是我的好看...... 正如Austin所说，这个用户论坛不是Xilinx的主要技术支持接入点，也许（我的猜测）这些论坛中支持行动的一半是由volounteers（同行用户/爱好者/学生/专业人士）提供的（显然） 太多的空闲时间。 让我们面对现实吧，当您从全职量产客户转变为全职业余爱好者（兼职园艺师）时，您不会得到销售代表的同样关注（以及很少的多道菜餐饮） 和他们一起工作的FAE。 - 鲍勃埃尔金德 签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。 阅读手册或用户指南。 你读过手册了吗？ 你能找到手册吗？2。 搜索论坛（并搜索网页）以寻找类似的主题。 不要在多个论坛上发布相同的问题。 不要在别人的主题上发布新主题或问题，开始新的主题！5。 学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。 提供有用的详细信息（请与网页，数据表链接）.7。 您的代码中的评论不需要支付额外费用。 我没有支付论坛帖子的费用。 如果我写一篇好文章，那么我一无所获。 |
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我的micro具有40mhz的单指令总线频率。
我必须有效地咬一口 - 外面的世界看起来像32个spi端口 - 每个端口同时运行，时钟频率为2.5mhz。 - 时钟频率意味着我必须以5.0 mhz的速率爆炸。 - 我只能以这些速度做4个输出。 您不能购买具有32个16位spi端口的微型 - spi通常只有8位，然后大多数我可以使用我的micro系列是3.输出协议需要在某些端口上进行曼彻斯特编码以及与之相关的时间延迟 将两个8位值推出一个spi可能会违反时序要求。 另一种方法是让微型简单地加载32个并行负载移位寄存器，为每个输出加载一个4位计数器，其时钟周期数（每个输出可以具有2到2.5 mhz之间的不同时钟速率）并让硬件执行实际 转移。 微型计算机的时间将缩短8到12倍 - 让它有时间为所有32台设备提供服务，并留出一些空间。 分立式实现占用了大量的电路板空间 - 即使使用表面贴装 - 这也是我想要走出舒适区并看看CLPD或FPGA是否能提供帮助的原因 - 但解决方案是价格驱动和电路板输出 必须是5v收发器驱动逻辑。 我希望技术在这方面留下这些“小”设计。 再次感谢。 乔 |
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我试过这个论坛是因为我花了两天的时间试图让FAE花15分钟跟我一起。
我直接尝试了Xilinx，我试过他们的经销商，似乎在电话上的谈话已经与恐龙消失了。 在我退休之前 - 6年前 - 情况并非如此 - 但我当时的职位也很有影响力。 今天 - 我只是一个试图开办车库商店的小家伙。 谢谢 |
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嗨乔，
如果你在论坛中四处看看，你会发现更多的“小家伙”，主要是学生，但也有很多爱好者，他们寻求设计问题的帮助。 许多人都可以得到帮助，但通常需要一天以上（在您的情况下，通过电话的不寻常的帮助）。 但这是通过写作和有时在世界各地进行沟通时的问题。 一些论坛帖子会持续数周，通常只是因为当一些新帖子到来时，相关人员处于睡眠状态。 当然，与过去相比，事情发生了变化，但让我问你一件事。 如果问题稍微复杂一些，您如何通过电话提供源代码，原理图和波形。 这可以在这样的论坛中方便地完成。 通过电话讨论可能有其优点，但也有缺点。 论坛讨论的工作方式不同，所以它有不同的专业和内容。 哪一个更好地工作取决于要解决的问题。 还有一个电话缺点： 我（以及世界其他地方）仍然不知道你的问题是如何解决的。 :-( 那么请您发布您的电话号码，以便来自世界各地的所有感兴趣的人都可以打电话给您了解该解决方案？ （请不要，开个玩笑。;-)） 亲切的问候 Eilert |
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