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FPGA千兆以太网发送数据，数据来自AD采集（有60MHz），经FIFO缓存。采用的UDP协议，一帧一帧传输数据，最后通信成功，但是漏包严重，后来发现是因为：AD不停地采集数据，但每一帧UDP数据包还需要传输包头、地址、端口号等，这段时间里采集的数据就丢失了。请问大家有没有什么解决办法呢？
补充内容 (2017-5-24 14:46): 我后来降低了采样频率，signal tapii里看到是没漏包的，但labview里看到是漏包了； 还有一个大问题，错包也很严重，一帧一帧的错误的数据，后来又取消了FIFO，错包要好些； 后来观察到数据在AD采集时，已经出错了（一段一段的），所以跟错包比起，漏包也可以容忍了，毕竟是有规律的漏包。 
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37个回答
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传输快些，采集减慢了，LabVIEW直接读取，不知道速度是怎样的 |
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没有啊，我上微机用的是C，我就是用verilog写的，之前我用labview来看，结果wireshark数据抓的对的，结果labview都不出来，后来我就用C了
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YIKE123 发表于 2017-5-25 13:48 那在传UDP的包头和其他地址、校验码信息时，没法传采集的数据啊，为什么你的数据没有丢？ |
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啊，我不太明白你说的没法传采集数据是什么意思，FPGA以太网上传数据打包先是以太网帧头 ip帧头 udp帧 +数据+CRC校验，什么没法传数据啊
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YIKE123 发表于 2017-5-25 15:51 你既然一直在采，就需要一直传啊，可每一帧数据都需要加头加尾，头尾的传输也需要时间啊，那这个时间段你采的数据放哪呢？ |
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YIKE123 发表于 2017-5-26 17:07 哦，我懂了，你这样采样频率会降低很多，我的不适用，我的50M已经够低了。非常感谢你的回答！ |
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巧了，我最近也做的ip-udp传输，但是我没用fifo，采集一个点发一个点
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可以留个联系方式吗？我有些问题也想请教你啊，我微信502137807
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谢谢分享，看看！！
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48k*20路*32bit，ddr3，还好
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上位机的问题。FPGA发送速度110M/S，在Windows系统下不管是用调试助手还是自己用QT写的接收测试程序，都会出现严重的丢包。在Linux系统下用QT写了测试程序，收到的数不作任何处理，只测速，测得的接收速度能达到110M/S，兄台有没有好的解决方法？
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更不用说LabView的实时性本身就差
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更不用说LabView的实时性本身就差
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暑假了，想学习FPGA的同学们，可以利用暑假期间好好学习下FPGA，我们现在有款初学者的FPGA开发板利器，现在购买还有配套书籍赠送哦： 入门FPGA开发板： https://item.taobao.com/item.htm ... &id=35911884243 赠送完全配套书籍： https://item.taobao.com/item.htm ... amp;id=540865636294 有一定基础的同学，可以看下高端的开发板： https://item.taobao.com/item.htm ... amp;id=520588767908 如果以上两款依然满足不了您的需求，更可以看下更高端的开发板： https://item.taobao.com/item.htm ... &id=39939126777 有任何问题，欢迎旺旺 QQ来咨询哦！ |
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先保存到flash中，再从flash中通过UDP传送
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我最近也在做类似的项目，
我的流程是这样的。 读取ADC数据-----FPGA的寄存器r_data-----写入FIFO 读取FIFO的的数据-----FAGA的寄存器USB_data----输出到USB芯片。 |
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