[经验] FPGA altera 时钟约束和IO约束说明

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dsc198981

技术员

发表于 2016-10-7 18:51:24　　 4328 查看 47 回复显示全部楼层倒序浏览

在设计以太网中继器时，因为没有配置时钟约束，导致中继器工作不正常。后面根据手册配置时钟约束解决了此问题。

Quartus II TimeQuest时序分析器说明书.pdf

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Mobli

助理工程师

发表于 2016-10-7 19:11:03　　

沙发

谢谢分享，学习学习

专业SMT贴片焊接，首次下单立减100元，华强集团旗下大厂，日式标准！

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王栋春

版主

发表于 2016-10-7 20:23:42　　

板凳

这个问题发生在何处

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chenfei11111111

助理工程师

发表于 2016-10-8 09:16:42　　

4^#

谢谢大家的分享。

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KYE_CQS

助理工程师

发表于 2016-10-8 09:19:10　　

5^#

谢谢分享。谢谢。

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dsc198981

技术员

发表于 2016-10-10 08:46:32　　楼主|

6^#

王栋春发表于 2016-10-7 20:23
这个问题发生在何处

在读写fifo会出现读不空

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srxh

助理工程师

发表于 2016-10-13 21:48:46　　

7^#

加油

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zhuhuren1984

技术员

发表于 2016-10-18 09:04:44　　

8^#

谢谢分享，学习学习

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星空下的屋顶

技术员

发表于 2016-11-12 20:12:21　　

9^#

好资料收藏中回帖表示感谢

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我的水墨嗳丹青

技术员

发表于 2017-1-16 11:28:57　　

10^#

积分不够用吗，回复就好了啊

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花涛

技术员

发表于 2017-1-19 21:34:02　　

11^#

学习一下，谢谢楼主！！

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泛爱不懂

技术员

发表于 2017-1-20 11:37:57　　

12^#

这个资料非常经典非常不错啊

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zlxdlg

技术员

发表于 2017-3-19 23:32:12　　

13^#

学习/学习/学习

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lutcn

技术员

发表于 2017-3-20 18:47:50　　

14^#

好东西，支持一下。

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yxfxd

实习生

发表于 2017-3-21 14:17:48　　

15^#

好东西，谢谢

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紫电魔焰

实习生

发表于 2017-3-21 21:17:54　　

16^#

需要用高速收发器，学习一下

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zjixxw

实习生

发表于 2017-6-26 16:38:23　　

17^#

好东西，谢谢

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zxs2888

等待验证会员

发表于 2017-7-13 20:37:03　　

18^#

谢谢楼主分享

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liqijian101

助理工程师

发表于 2017-7-14 07:36:17　　

19^#

{:1:}{:1:}{:1:}{:1:}{:1:}{:1:}{:1:}{:1:}{:1:}

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Booligan

实习生

发表于 2017-7-15 20:55:58　　

20^#

额嗯谢谢分享

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