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亲爱的专家,
我对FPGA很新,所以如果我的问题很愚蠢,我很抱歉。 我正在开发一个使用Virtex 6设计NAND闪存控制器的项目。 闪存器件使用HSUL_12 IO标准,但Virtex 6不支持该IO标准。 现在,我将LVCMOS12用于Virtex 6.我遇到的问题是,当我将命令传递给闪存设备时,读回的数据为零。 我的问题是:连接两个不同的IO标准(Virtex 6的LVCMOS12的闪存设备的HSUL_12)是否有任何问题? 非常感谢你。 |
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7个回答
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您将LVCMOS12 I / O连接到1.2V的银行的VCCO?
------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com |
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嗨Thanhnd,
检查闪存中的HSUL_12 IO标准规格,如vih vol vil vol,看看这是否符合virtex-6的LVCMOS12 Iostandard(vih vol vil vol)的规格,该规格在以下数据表中给出 http://www.xilinx.com/support/documentation/data_sheets/ds152.pdf HSUL_12是基于vref的,因此请检查是否根据闪光灯的规格给出了此电压。 --Krishna |
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嗨kkn,
我检查了规格。 FPGA: LVCMOS12:VIL max = 0.42V,VIH min = 0.78,VOL max = 0.3,VOH min = 0.9 Flash: HSUL_12:VIL = 0.47 max,VIH min = 0.73,VOL max = 0.12V,VOH min = 1.08V。 这些电压似乎没有问题。 在Flash器件中,VREF = 0.5 * VCC。 那么,HSUL_12和LVCMOS12之间的连接没有问题? 如果是这样,也许我的问题来自不同的来源,我必须弄清楚。 谢谢您的回复。 |
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正如@kkn指出的那样,HSUL_12接口应该使用基于VREF的输入缓冲器,而在Virtex-6的情况下,IOSTANDARD将是HSTL_I_12(VCCO = 1.2,VREF = 0.6)。
如果您的电路板没有包含VREF电压,那么您可以使用设计约束INTERNAL_VREF_BANK ## = 0.60; 其中##是您的IO所在的银行编号。 有关更多信息,请参阅Virtex-6 SelectIO用户指南UG361的“内部VREF”部分。 基于您引用的数据表值,我预计LVCMOS12会产生有效的0/1状态,因此我建议您在引脚上放置一个示波器,以确切了解该线路在您的电路板上的实际作用。 可能还有其他错误。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com |
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感谢mcgett的回复。
似乎我的问题不是来自IO标准。 我已经检查过,虽然闪存(cko / cko#)的输出时钟似乎没问题,但Flash内部的PLL还没有被锁定。 闪存的差分输入时钟由FPGA板内的DCM直接生成。 我试图使用ODDR将时钟输出到闪存。 但PLL仍未锁定。 你能给我一些建议吗? FPGA板的系统振荡器有问题吗? 我期待着你的帮助。 谢谢 |
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>你能给我一些建议吗?
抱歉,但由于没有足够的信息,我(以及论坛用户)目前无法提供帮助。 您需要查看正在使用的Flash设备的数据表,并将其与您构建的自定义板进行比较,以验证其设计是否正确,然后根据Flash的重置和启动要求验证您的接口代码 设备。 ------您是否尝试在Google中输入问题? 如果没有,你应该在发布之前。太多结果? 尝试添加网站:www.xilinx.com |
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只有小组成员才能发言,加入小组>>
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