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[问答] 在verilog 95/2k中不允许使用Waring Root scope decartion
103 xilinx Verilog
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大家好
我正在使用xflow在ISE 13.3中实现一个设计。
在我的一个参数文件工具中的文件汇编期间,显示警告“在verilog 95 / 2k中不允许使用Waring Root scope decartion。
我使用-vlincdir选项将该文件目录作为包含路径包含在.opt文件中。
我的参数文件如下: -
//文件的开头
`定义BUS 64
参数data_bus_width = BUS
//文件结尾
提前致谢
Vir_1602
0
2020-3-12 11:19:20   评论 分享淘帖 邀请回答

相关问题

8个回答
嗨,
是否有可能分享完整的设计以重现我的问题?
请参阅本文,其中包含有关参数的有用信息。
http://ocw.mit.edu/courses/electrical-engineering-and-computer-science/6-884-complex-digital-systems-spring-2005/related-resources/parameter_models.pdf
在原帖中查看解决方案
2020-3-12 11:33:26 评论

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嗨,
是否有可能分享完整的设计以重现我的问题?
请参阅本文,其中包含有关参数的有用信息。
http://ocw.mit.edu/courses/electrical-engineering-and-computer-science/6-884-complex-digital-systems-spring-2005/related-resources/parameter_models.pdf
2020-3-12 11:46:47 评论

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嗨,请参考以下可能有用的主题http://forums.xilinx.com/t5/Simulation-and-Verification/ISIM-running-out-of-memory/td-p/305247
谢谢,维杰-----------------------------------------------
---------------------------------------------请将帖子标记为
一个答案“接受为解决方案”,以防它有助于解决您的查询。如果一个帖子引导到解决方案,请给予赞誉。
2020-3-12 12:00:30 评论

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感谢Manusha的回复
但由于comapny政策,我无法分享确切的设计
但我给了我的参数文件的原型和我在我的一些模块中使用的data_bus_width参数。
当我试图调试;
删除分配,即“参数data_bus_width =`BUS”到data_bus_width = 64“或某个数值后,这个错误已经解决,但我想知道是什么问题;
在你的最后创建senario
你可以写
模块x(...);
input data_bus [data_bus_width-1:0];
输出..



endmodule
并使用参数文件,当我使用gui相同的文件时,还有一件事;
这个错误不会发生
感谢致敬
Virat Sharma
2020-3-12 12:16:31 评论

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嗨vijay
在那个你给出参数的senario是在模块声明之前给出的,这就是给出错误的原因。
但在我的情况下,我已经在模块声明后包含该文件。
2020-3-12 12:22:19 评论

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嗨manusha
在模块声明中,我已经在模块声明之后包含了文件
Modudle xyz(..);
`include param.v
....
...
..
endmodule
2020-3-12 12:34:41 评论

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嗨,检查http://forums.xilinx.com/t5/Synthesis/Alternatives-to-parameter-in-Verilog/td-p/305837
谢谢,维杰-----------------------------------------------
---------------------------------------------请将帖子标记为
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2020-3-12 12:54:37 评论

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您好@ vir_1602,以上建议是否帮助您找到所需信息?
如果是,请通过标记解决方案来关闭线程。
谢谢,维杰-----------------------------------------------
---------------------------------------------请将帖子标记为
一个答案“接受为解决方案”,以防它有助于解决您的查询。如果一个帖子引导到解决方案,请给予赞誉。
2020-3-12 13:13:50 评论

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