发 帖  
原厂入驻New
[问答] Quartus 17.1模块字体显示不全
305 FPGA
分享

模块的名字显示不全,看着很难受,刚入门的菜鸟跪求大佬这么解决这个问题!!!
1

Quartus 17.1模块名字显示不全

Quartus 17.1模块名字显示不全
奖励3积分
2020-2-18 22:28:00   评论 分享淘帖 邀请回答
2个回答
-------------声明:这种情形没遇到过。-------------
01.首先建议更改显示器的分辨率;
02.针对symbol的字体重叠显示不全,可以尝试自己修改。
    右键-->Edit Select Symbol-->弹窗(可以自己修改尺寸)
03.引脚重叠,直接通过鼠标拖拉可以展开。
2020-2-18 23:38:52 评论

举报

一个是时序约束,另一个就是逻辑锁定。时序约束是按照你的时序要求去布局布线。而逻辑锁定则是指设计者将某个模块或者某个网络指定在器件的某个位置。尽管有时序约束,但综合器也不能保证每次都能达到要求;而只有当逻辑锁定后,它能保证被锁定的模块在下一次综合不被改变。   事出有因,之前加进来的一个SPI模块,一开始是正常的,后来陆续在设计中加了一些模块,综合后,居然发现SPI模块工作不正常,奇怪的是,在我备份的几个版本中,有几个正常,有几个又不正常,而在这个过程中SPI模块从未被修改过。我想一定是综合器在捣鬼,后来我在SPI正常的版本上查看chip planner中spi的布局信息,然后将其逻辑锁定,再添加新的模块进来,结果发现,SPI果然没有受到影响。
2020-2-19 16:30:42 评论

举报

撰写答案

你正在撰写答案

如果你是对答案或其他答案精选点评或询问,请使用“评论”功能。

高级模式
您需要登录后才可以回帖 登录 | 注册

声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容图片侵权或者其他问题,请联系本站作侵删。 侵权投诉
我要提问
关闭

站长推荐 上一条 /7 下一条

快速回复 返回顶部 返回列表