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[问答] 请问68103A fifo数据传输延迟该怎么办?
152 FIFO 比特
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FPGA Outs68013A(100PIN),从奴隶FIFO,散装,EP2输出EP6英寸,SouthEndoStidAccess,全速,16BITBUS。
在一次到位中,8位比特的8位比特,8位比特,1比特,1比特比特,8比特比特。
IsCouth-TimeAddioStay-IfCalthOffice 55-48兆赫,SouthSouthaudio AN6337。
一个又一个!
三、中国人民代表大会/ *********************************************************************************************************************************************************************************************************
IFCONFIG=0x8b;//0x0b;//0xCb;//30MHz
/我们只是使用默认值,是的,这不是必要的…EP1OUTCFG=0xA0;EP1CIFFG=0xA0;SYNCDELAY;//参见TRM第15.14部分EP2CFG=0xA2;SYNCDELAY;//EP4CFG=0xA0;SYNCDELAY;//EP6CFG= 0xE2;SYNCDELAY;//EP8CFG= 0xE0;
EP2FIFOCFG=0x11;SycCelp;EP4FIFOCFG=0x11;SycCelp;EP6FIFOFFG=0x09;SycCdEnter;EP8FIFOCFG=0x09;SYNCDELAY;
EP6BCL=0x80;同步延迟;EP6BCL=0x80;同步延迟;EP8BCL=0x80;SycCdEnter;EP8BCL=0x80;SYNCDELAY;//Outlook端点未出现武装/ /由于默认是双缓冲的,我们必须通过写入字节计数W/SKIP写入虚设字节计数两次SycCdTrime//EP2BCL=0x80;//ARM EP2OUT。SycCurror;//EP4BCL=0x80;SYNCDELAY;//EP2BCL=0x80;//ARM EP4OUT,通过写入字节计数W/SKIP。同步延迟;//EP4BCL=0x80;
PoACACFG=0x40;
/填充端点
//用于(i=0;I/6FIFOBUF=i+2;///EP6BCH=0x02;///EP6BCL=0x00;////为(i=0;I & lt;512;I++)//EP6FIFOBUF=i+2;//SycClice;///EP6BCH=0x02;//SycClice;///EP6BCL=0x00;
//MyBuffeCal计数=0;
//启用双自动机(S)/AutoPrStuts*=0x01;
}
当设备空闲时{ IFCONFIG=0x8B;//0x0b;//如果EP6 IN可用,则重新武装它(如果),则重复TDY轮询(空隙)/ /调用。(EP2468 STAT和BMEP6FULL){SimcRead;EP6BCH=0x02;SYNCDELAY;//EP6BCL=0x00;//MeMSET(EP6FIFOBUF,0x01024);//如果在EP2中存在一些数据,则重新武装它(如果)!(EP2468 STAT和BME2BULL){SimCtRelay;//EP2BCL=0x80;}
三、中国人民代表大会/ *******************************************************************************************************************************************
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821.4 K
0
2019-10-30 10:43:28   评论 分享淘帖 邀请回答
1个回答
雄蕊上着缘,先于雄蕊。
2019-10-30 10:53:16 评论

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