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多年来,我一直使用Microchip初学者工具包和相关的布局/图表作为我自己设计的模板。这很好。我现在正在设计一款PIC32 MZ设计,带有集成磁力的LAN872和RJ45。再次都很好。根据LAN840PHY子板,我的LAN872很好地定位在板的另一侧的RJ45下。迟些时候,我检查了10/100以太网的EMI建议,发现许多认为PHY芯片距离磁体不超过25mm的PHY芯片是不推荐的。如果PHY芯片和以太网磁体之间存在耦合,那么共模EMI问题很有可能。首先,LAN840PHY子板是否也有符合RJ45 +磁体的PHY芯片,符合美国/欧盟EMI标准?如果是这样,这是因为他们选择了良好屏蔽的RJ+磁力的结果?如果不是,这个物理布局的量级是美国还是欧盟标准?谢谢你。
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1个回答
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我怀疑你在读LAN8742A校验单。如果我在黑板上有空位,我总是使用额外的间隔和分离的磁体和RJ45插孔。这样更容易通过EMI测试。还有单独的磁体,我在BOM管理上有一个更轻松的时间。如果我没有空间,那么我必须使用组合磁杰克。使用高品质的MagJack,如BelFiSE,以获得最佳效果。在过去,当需求上升时,我曾遇到供应问题,但交货时间突然中断。请务必提交您的示意图和gerbers供LANCHECK评审。让第二组眼睛检查董事会并给出建议以帮助通过EMI测试是不会有任何伤害的。
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