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是否可以访问Verilog中的A0寄存器的内容？
有很多使用Verilog将数据路径移位器的输出发送到PIN的例子。但是我找不到通过数据通路从FIFO发送一个8位并行值到输出引脚的任何例子。 从FIFOTO到A0加载一个值，让ALU对其执行操作，然后用Verilog访问结果，将其引导到输出引脚。 各种数据通路文件显示8位PO（并行输出）信号连接到SRCA的输入端。但是没有文档说明如何利用这个输出！ 以上来自于百度翻译 以下为原文 Is it possible to access the contents of the A0 register within Verilog ? There are plenty of examples of using verilog to send the output of the Datapath shifters to a pin. But I cannot find any example of sending an 8-bit parallel value from the FIFO to an output pin via the datapath. Eg. Load a value from the FIFO into A0, have the ALU perform an operation on it, then have verilog access the result to direct it to an output pin. The various datapath documention shows the 8-bit PO (parallel output) signal being connected to the input of SRCA. But there is no documentation how to make use of this output! 
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3个回答
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我会让专家回答这个问题，但这可能是有用的。
CyPress .CON/AN82156 问候，Dana。 以上来自于百度翻译 以下为原文 I will let an expert answer this, but this might be useful - www.cypress.com/ AN82156 Regards, Dana. |
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我从另一个论坛帖子中找到了使用PO和PI的一些线索：
看起来我需要从CypPoS3Y-DP8模块过渡到CysPoS3xDP模块，以获得对它们的访问。 以上来自于百度翻译 以下为原文 I found some clues on using PO and PI from another forum post at: www.cypress.com/ Looks like I need to transition from the cy_psoc3_dp8 module to the base cy_psoc3_dp module to get access to them. |
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您好，MMCM师硕士，请看这篇文章，13 / OCT P5LPYDDS [ 2 ]。（…）zip文件HTTP://wwwyCysP.COM/？APP＝论坛＝2492和RID＝86654，它使用控制寄存器和状态寄存器将8位数据传递给Verilog模块。查看组件标签，DD.CysCH文件，DDCORE是VRIIG模块。这不是使用DATAYPATH，但是这种方便的方式是可行的。能帮到你吗？
以上来自于百度翻译 以下为原文 Hello mmcmaster Please look at this article, 13/Oct P5LP_DDS[2].()...zip file http://www.cypress.com/?app=forum&id=2492&rID=86654 It is use Control register and Status register for passing 8bit data to Verilog module. Look component TAB, DDS.cysch file, DDsCore is the Veriog module. It's not use data_path however, This handy way is doable what you want to. Can it help you? |
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