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你好，
我最近开始对2个CY3255设备进行通信测试（低电压12 /24V PLC DEVKITS）。 我在示波器上显示了输出信号（FSK），并计算出在预期的时间内数据包没有被传输。 我修改的例子程序，为了给全39b包（1B（0xab）+ 6b头+数据+ 31b 1b CRC）。因此，大约需要130ms @ 2400bps被传送。 示波器显示我的包需要200ms发送。 TEK09003.PNG 74.8 K 以上来自于百度翻译 以下为原文 Hi, I rencently began some tests on 2 CY3275 devkits communicating together (low voltage 12/24V PLC devkits). I displayed the output signal (FSK) on an oscilloscope and figured out that the packet isn't transmitted within the expected time. I modified the example programs in order to send a full 39B packet (1B (0xAB) + 6B header + 31B data + 1B CRC). So it should take approximately 130ms @ 2400bps to be transmitted. The oscilloscope shows me that the packet takes 200ms to be transmitted.
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8个回答
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用我从未使用过的一点盐来评价我的评论。
工具箱之前，但是在协议固件中有变量保持跟踪 由于电力线噪声的数据包重试？这可能是一个指标 表演的。 你总是可以把范围无限坚持看 电力线，以获得PK PK噪声随着时间的推移。 问候，Dana。 以上来自于百度翻译 以下为原文 Take my comments with a grain of salt as I have never used the kit before, but in the protocol firmware is there a variable keeping track of packet retrys due to power line noise ? That may be an indicator of performance. You could always put a scope on infinte persistance and look at the power line to get a handle on pk-pk noise over time. Regards, Dana. |
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我总是计算一个串行传输12位/字节，因为有开始和停止位和一个奇偶校验。当我把你的38个字节@ 2400波特，我得到195ms，这是相当接近你观察到的200毫秒。
鲍勃 以上来自于百度翻译 以下为原文 I always calculate a serial transmition with 12 bits / byte since there are start- and stop-bits and a parity as well. When I take your 38 bytes @2400 baud I get 195ms which is rather close to your observed 200ms. Bob |
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鲍伯，我一定漏掉了什么东西。
8位/字节+ 1 + 1 + 1站开始平价= 11位x 38字节×1 / 2400波特率= 174毫秒 问候，Dana。 以上来自于百度翻译 以下为原文 Bob, I must be missing something. 8 bits/byte + 1 stop + 1 start + 1 parity = 11 bits x 38 bytes x 1 / 2400 baud = 174 mS Regards, Dana. |
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啊，我错过了2个停止位，而不是1个。
衰老正在迅速消失。 问候，Dana。 以上来自于百度翻译 以下为原文 Ah, I missed 2 stop bits vs 1. Senility is closing in rapidly. Regards, Dana. |
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它不被称为衰老，它被称为计算障碍，它可以通过每天有27个嘧啶和一个奎宁来治愈。
鲍勃 以上来自于百度翻译 以下为原文 It is not named senility, it is named dyscalculia and it may be healed by having 27 pirimes and a qube a day. Bob |
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谢谢你的回复！
我不知道每个字节都有开始/停止/奇偶校验位。它可以配置还是绕过？ 谢谢你 以上来自于百度翻译 以下为原文 Thank you for your replies ! I didn't know there was start/stop/parity bits for each byte transmitted. Can it configured or bypassed ? Thank you |
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StastButts是必不可少的，并且不能避免（可能在长度上改变），ScBIT可以被省略（通常）。奇偶校验可能会被省略，但是由于协议是标准化的，所以应该坚持默认。检查用户模块和PSoC的数据表。
鲍勃 以上来自于百度翻译 以下为原文 Startbits are essential and cannot be avoided (maybe changed in length), stopbit can be ommitted (usually). Parity may be ommitted, but since the protocol is standardized you should stick to the default. Check datasheet of usermodule and PSoC. Bob |
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奇怪，我似乎无法找到一个EIA规格UART串口，16550基础，
但不接收至少需要一个停止位避免帧错误？ www. FriBSD.Org/DoC/En/ToeSale/SerialUART/ en.wikipedia.org/wiki/universal_asynchronous_receiver/transmitter 问候，Dana。 以上来自于百度翻译 以下为原文 Odd, I cannot seem to find a EIA spec on serial UART, 16550 basis, but doesn't the receiver need at least 1 stop bit to avoid a framing error ? www.freebsd.org/doc/en/articles/serial-uart/ en.wikipedia.org/wiki/Universal_asynchronous_receiver/transmitter Regards, Dana. |
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只有小组成员才能发言，加入小组>>
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加入小组1901 浏览 1 评论
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请问可以直接使用来自FX2LP固件的端点向主机FIFO写入数据吗？
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