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实现的功能很简单,只是为了应付期末考试,不过还是对基础有点要求,都几个月没看FPGA了,写的不是很好,不过功能是实现了
写时遇到的问题 1 tb里将输入端口定义为input,本应为reg 2 实现逻辑与的功能,输出应该只有0和1,而自己在设计时用sign函数,输出为1和-1,所以结果一直不对;总会出现震荡 3 更新权值时,有时只更新一个,有时更新一个权值写的都不一样,像下面这样写能得结果才怪 1 3'b101:w12=w01+ARF; 3'b011:w12=w01-ARF; //阶跃 //3'b101:w12=w01+{ARF[9:0],1'b0};//ARF*2 //3'b001:w12=w01-ARF; //3'b011:w12=w01+ARF; default:w12=w02; 2 3'b101:w11=w01+ARF; 3'b011:w11=w01-ARF; //阶跃 //3'b101:w11=w01+{ARF[9:0],1'b0};//ARF*2 //3'b001:w11=w01-ARF; //3'b011:w11=w01+ARF; default:w12=w02;
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