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黄勇叶先生

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3D库文件

wudangui 12-10 16:48 0 评论 6891阅读

allegro17.2如何建立在内层建立封装---短路铜皮

李权 09-24 21:07 0 讨论 9499阅读

帮忙转下.bdr文件

huyilei 04-19 09:08 0 评论 595阅读

关于螺钉孔敷铜问题

jf_98584191 04-13 13:19 0 回答 9095阅读

allegro导出IPC时出错问题的原因

jf_07162089 04-13 11:30 0 评论 476阅读

Model Integrity 进行IBIS转DML时总是报错 ibis2signoise failed Could not create xx.dml Please refer to Logfile for details!

jf_18210233 03-23 14:33 0 回答 9585阅读

这种图是怎么做的，应该导出什么格式 attach_img

rabbitfix 02-27 23:11 0 回答 10192阅读

ALLEGRO DRC错误T/P，求指导

张静楠 11-29 17:50 0 回答 17661阅读

allegro 盲孔资料怎么出？

gdutchen 11-15 08:44 0 回答 26819阅读

CIS配置后missing Schematic Part

gdutchen 11-13 15:02 0 回答 23405阅读

怎么办

学森自行车vbnm 10-28 16:15 0 回答 33157阅读

candence 17.4 DRC检查不了

马大哈1111 09-21 10:34 1 回答 68246阅读

怎么快速对齐过孔和文字

木少川 09-01 14:08 0 回答 75587阅读

有大佬遇到这个问题吗？图一明明是已经给4对差分线建立model了，为啥图二只显示只有一对建立成功呢？？？？？

陀日皓 07-30 11:16 0 回答 52384阅读

allegro中workflow manager求解

李立 03-07 22:02 0 回答 47841阅读

tabbed routing 如何自动赋予属性。 attach_img

张文 03-07 17:04 0 回答 59054阅读

cadence原理图如何生成智能PDF

zqhmcu2 10-28 15:08 0 讨论 38100阅读

Allegro PCB Designer 17.2版本保存后点关闭就未响应

taojw123 09-28 20:49 0 回答 31937阅读

cadence高速电路板设计与仿真-原理图与PCB设计第3版-高清无水印-part1 attachment

杨坤 08-26 11:04 0 评论 15166阅读

allegro16.6走线快捷键设置

Hedy久久 07-12 14:06 0 讨论 46286阅读

用Cadence Sigrity仿真DDR模组，怎么提取出.ckt的MCP头文件 attach_img

Jaber 05-27 18:14 0 回答 39202阅读

Allegro内电层覆铜不会绕开其他网络的过孔 attach_img

子安G 03-28 23:10 0 回答 38418阅读

板内快速复用和板间快速复用 attach_img

叶先生 03-18 21:11 0 评论 9913阅读

allegro在进行规则检查时报错

韩柯 01-19 18:00 0 回答 51342阅读

1、[问]高频信号布线时要注意哪些问题？

leslie_aqiang 01-03 16:29 0 回答 41317阅读

allegro如何将走线的圆弧变为矩形? attach_img

jf_31570558 10-15 19:12 0 回答 32175阅读

BRD板和LIB库之间LIB库和LIB库之间的封装和焊盘差异 attach_img

叶先生 08-24 12:50 0 评论 3586阅读

如何找回 Cadence Allegro Product Choices dialog

朴泰桓 07-08 20:28 0 回答 29518阅读

谁有安捷伦HP54548A示波器的系统

6063 07-05 09:33 0 评论 25783阅读

Cadence与PLM集成接口实例 attach_img

叶子 07-03 17:36 0 评论 5427阅读

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