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黄勇叶先生

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怎么快速对齐过孔和文字

木少川 09-01 14:08 0 回答 75489阅读

candence 17.4 DRC检查不了

马大哈1111 09-21 10:34 1 回答 68143阅读

Cadence在Windows11上是否能正常安装破解

木少川 09-28 11:34 1 回答 66754阅读

Allegro 16.3 铺铜如何设置安全间距 attach_img

claytoncn 06-01 09:49 17 回答 63609阅读

tabbed routing 如何自动赋予属性。 attach_img

张文 03-07 17:04 0 回答 58955阅读

Allegro 17.4 show element和measure弹窗都是空白，请问是什么问题，已经装了最新补丁。 attach_img

Stu00000 04-24 11:06 10 回答 56565阅读

cadence16.6打开cadence17.4文件

D 12-23 17:53 4 回答 55109阅读

使用orcad自制元件OK后，重新打开发现元件一脚莫名集中在一点，且引脚显示为zero length，这是为什么

张开灿 11-05 10:13 4 回答 54910阅读

Allegro PCB中过孔位置提示了这样的DRC错误信息是因为什么呢？ attach_img

加彬 08-24 14:14 2 回答 54643阅读

有大佬遇到这个问题吗？图一明明是已经给4对差分线建立model了，为啥图二只显示只有一对建立成功呢？？？？？

陀日皓 07-30 11:16 0 回答 52289阅读

【请问】Orcad 如何锁定元件属性？除了位号，其它都不能修改。 attach_img

mikelxz 02-23 20:02 1 回答 51924阅读

allegro在进行规则检查时报错

韩柯 01-19 18:00 0 回答 51248阅读

大哥们，在allegro中怎么添加过孔并改网络啊？

刘瑞 11-04 16:24 4 回答 50030阅读

关于ALLEGRO中PCB导入原理图时出现的问题 attach_img

方正 07-27 12:30 13 回答 49884阅读

allegro中workflow manager求解

李立 03-07 22:02 0 回答 47743阅读

PSpice仿真出现错误，求大神指点

葛小馬 10-27 14:01 1 回答 44177阅读

cadence16.6安装问题 attach_img

Albert 12-09 15:50 23 回答 43958阅读

ALLEGRO软件检查设计中是否有问题，元器件布局及焊盘设置？

八月八日雨 02-04 18:33 1 回答 41790阅读

Allegro16.6 铺铜时，出现铺铜不成功，多次铺铜后出现边框层叠起来

谢华奇 03-24 15:14 2 回答 41491阅读

1、[问]高频信号布线时要注意哪些问题？

leslie_aqiang 01-03 16:29 0 回答 41219阅读

导入网表出现这个错误怎么解决 attach_img

丘拍拍 02-16 16:59 33 回答 40940阅读

cadence16.6生成网络表出问题，哪位大神帮忙指点一二

蜗牛 11-27 11:04 7 回答 40898阅读

找杜正阔一本书，书名叫 cadence Allegro 实战攻略与高速PCB设计；书的封面见附件图片： attach_img

chaoyueTX 09-30 16:16 10 回答 40840阅读

网络表导入就去了，却什么也没有？ attach_img

lzp961 01-12 14:05 2 回答 40548阅读

怎样才能知道cadence16.6已经破解成功了？ attach_img

Albert 03-24 16:59 8 回答 39320阅读

用Cadence Sigrity仿真DDR模组，怎么提取出.ckt的MCP头文件 attach_img

Jaber 05-27 18:14 0 回答 39110阅读

请问怎样显示丝印层 attach_img

曾俊 09-25 23:51 5 回答 38842阅读

Allegro内电层覆铜不会绕开其他网络的过孔 attach_img

子安G 03-28 23:10 0 回答 38320阅读

allegro框选时框选框跟不上鼠标速度 attach_img

lr 11-22 17:16 3 回答 37552阅读

cadence中敷铜后如何修改shape与过孔、走线之间的间距

张雪 09-29 14:20 4 回答 36733阅读

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